IDT72V3612 3.3V, CMOS SyncBiFIFOTM 64 x 36 x 2 COMMERCIALTEMPERATURERANGE Figure 18. ODD/EVEN" />
參數(shù)資料
型號(hào): IDT72V3612L12PQF
廠(chǎng)商: IDT, Integrated Device Technology Inc
文件頁(yè)數(shù): 15/24頁(yè)
文件大?。?/td> 0K
描述: IC FIFO 64X36X2 12NS 132QFP
標(biāo)準(zhǔn)包裝: 36
系列: 72V
功能: 異步
存儲(chǔ)容量: 4.6K(64 x 36 x2)
數(shù)據(jù)速率: 83MHz
訪(fǎng)問(wèn)時(shí)間: 12ns
電源電壓: 3 V ~ 3.6 V
工作溫度: 0°C ~ 70°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 132-BQFP 緩沖式
供應(yīng)商設(shè)備封裝: 132-PQFP(24.13x24.13)
包裝: 托盤(pán)
其它名稱(chēng): 72V3612L12PQF
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IDT72V3612 3.3V, CMOS SyncBiFIFOTM
64 x 36 x 2
COMMERCIALTEMPERATURERANGE
Figure 18. ODD/EVEN
EVEN
EVEN W/R
RR
RRB, MBB, and PGB to PEFB
PEFB
PEFB Timing
NOTE:
1. ENB is HIGH, and CSB is LOW.
Figure 20. Parity Generation Timing when Reading from Mail1 Register
NOTE:
1. ENB is HIGH.
Figure 19. Parity Generation Timing when Reading from Mail2 Register
NOTE:
1. ENA is HIGH.
4659 drw 21
ODD/
EVEN
PEFB
PGB
MBB
W/
RB
Valid
tPOPE
tPEPE
tPOPE
tPEPE
4659 drw 22
ODD/
EVEN
A8, A17,
A26, A35
PGA
MBA
W/
RA
Mail2
Data
Generated Parity
Mail2 Data
CSA
LOW
tEN
tPEPB
tPOPB
tPEPB
tMDV
4659 drw 23
ODD/
EVEN
B8, B17,
B26, B35
PGB
MBB
W/
RB
Mail1
Data
Generated Parity
Mail1 Data
CSB LOW
tEN
tPEPB
tPOPB
tPEPB
tMDV
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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IDT72V3612L15PQF 功能描述:IC FIFO 64X36X2 15NS 132QFP RoHS:否 類(lèi)別:集成電路 (IC) >> 邏輯 - FIFO 系列:72V 標(biāo)準(zhǔn)包裝:90 系列:7200 功能:同步 存儲(chǔ)容量:288K(16K x 18) 數(shù)據(jù)速率:100MHz 訪(fǎng)問(wèn)時(shí)間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類(lèi)型:表面貼裝 封裝/外殼:64-LQFP 供應(yīng)商設(shè)備封裝:64-TQFP(14x14) 包裝:托盤(pán) 其它名稱(chēng):72271LA10PF
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