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參數(shù)資料
| 型號： | IDT72T51253L6BB |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | 2.5V MULTI-QUEUE FLOW-CONTROL DEVICES (32 QUEUES) 36 BIT WIDE CONFIGURATION 1,179,648 bits and 2,359,296 bits |
| 中文描述： | 128K X 18 OTHER FIFO, 3.7 ns, PBGA256 |
| 封裝： | 17 X 17 MM, 1 MM PITCH, PLASTIC, BGA-256 |
| 文件頁數(shù)： | 40/55頁 |
| 文件大?。?/td> | 544K |
| 代理商： | IDT72T51253L6BB |
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40
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT72T51233/72T51243/72T51253 2.5V, MULTI-QUEUE FLOW-CONTROL DEVICES
(4 QUEUES) 18 BIT WIDE CONFIGURATION 589,824, 1,179,648 and 2,359,296 bits
RCLK
RADEN
Qout
REN
t
AH
t
AS
Don’t care
RDADD
t
A
NULL QUEUE
SELECT
*A*
*B*
*C*
*E*
*G*
t
A
Q3 W0
FWFT
t
ROV
6115 drw21
t
QH
t
ENS
Q1 Wn-4
Q1 Wn-3
Q1 Wn-2
t
A
t
A
Q1 Wn
t
ROV
OV
SELECT
NEW QUEUE
*D*
00100
t
AH
t
AS
t
QH
t
QS
t
ENH
t
QS
t
AH
t
AS
Null-Q
*F*
Q1 Wn-1
t
A
Figure 17. Read Operation and Null Queue Select
NOTES:
1. The purpose of the Null queue operation is so that the user can stop reading a block (packet) of data froma queue without filling the 2 stage output pipeline with the next words
fromthat queue.
2. Please see Figure 18,
Null Queue Flow Diagram
.
Cycle:
*A*
Null Q of device 0 is selected, when word Wn-1 frompreviously selected Q1 is read.
*C*
REN
is HIGH and Wn (Last Word of the Packet) of Q1 is pipelined onto the O/P register.
Note: *B*and *C*are a mnimum3 RCLK cycles between queue selects.
*D*
The Null Q is seen as an empty queue on the read side, therefore Wn of Q1 remains in the O/P register and
OV
goes HIGH. A new queue, Q3 is selected.
*G*
1st word, W0 of Q3 falls through present on the O/P register after 3 RCLK cycles after the queue select.
Queue 1
Memory
*A*
*B*
Null
Queue
*C*
O/P Reg.
*D*
*E*
*F*
Null
Queue
Q1
Wn
Queue 3
Memory
O/P Reg.
O/P Reg.
O/P Reg.
O/P Reg.
O/P Reg.
Qn
Wn-2
Q1
Wn
Q1
Wn-1
Q1
Wn
Q1
Wn
Q1
Wn
Q1
Wn
Q1
Wn
Q1
Wn
Q4
W0
Q1
Wn
Queue 1
Memory
Null
Queue
6115 drw22
*G*
Queue 3
Memory
O/P Reg.
Q4
W1
Q3
W0
Figure 18. Null Queue Flow Diagram
相關PDF資料 |
PDF描述 |
|---|---|
| IDT72T51233 | 2.5V MULTI-QUEUE FLOW-CONTROL DEVICES (32 QUEUES) 36 BIT WIDE CONFIGURATION 1,179,648 bits and 2,359,296 bits |
| IDT72T51233L5BB | 2.5V MULTI-QUEUE FLOW-CONTROL DEVICES (32 QUEUES) 36 BIT WIDE CONFIGURATION 1,179,648 bits and 2,359,296 bits |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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