IDT72T1845/55/65/75/85/95/105/115/125 2.5V TeraSync 18-BIT/9-BIT FIFO
參數(shù)資料
型號： IDT72T1855L5BB
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 43/55頁
文件大?。?/td> 0K
描述： IC FIFO 4096X18 2.5V 5NS 144BGA
標準包裝： 1
系列： 72T
功能： 異步，雙端口
存儲容量： 72K（4K x 18）
數(shù)據(jù)速率： 10MHz
訪問時間： 5ns
電源電壓： 2.375 V ~ 2.625 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 144-BGA
供應商設(shè)備封裝： 144-PBGA（13x13）
包裝： 托盤
其它名稱： 72T1855L5BB
48
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
IDT72T1845/55/65/75/85/95/105/115/125 2.5V TeraSync 18-BIT/9-BIT FIFO 2Kx18/4Kx9, 4Kx18/
8Kx9, 8Kx18/16Kx9, 16Kx18/32Kx9, 32Kx18/64Kx9, 64Kx18/128Kx9, 128Kx18/256Kx9, 256Kx18/512Kx9, 512Kx18/1Mx9
FEBRUARY 10, 2009
Figure
28.
Echo
Read
Clock
&
Read
Enable
Operation
(IDT
Standard
Mode
Only)
tENS
tENH
tENS
RCS
RCLK
REN
Qn
tERCLK
tENS
5909
drw32
ERCLK
tENH
EREN
tCLKEN
tREF
EF
W
D-4
tA
tOLZ
tOHZ
tA
tOLZ
tA
Last
Word,
W
D
W
D-3
W
D-3
W
D-2
W
D-1
tCLKEN
NOTES:
1
.
The
EREN
output
is
an
“ANDed”
function
of
RCS
and
REN
and
will
follow
these
inputs
provided
that
the
FIFO
is
not
empty.
If
the
FIFO
is
empty,
EREN
will
go
HIGH,
thus
preventing
any
reads.
2
.
The
EREN
output
is
synchronous
to
RCLK.
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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IDT72T1855L6-7BB 功能描述:IC FIFO 4096X18 6-7NS 144BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標準包裝:90 系列:7200 功能:同步 存儲容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應商設(shè)備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF
IDT72T1865L4-4BB 功能描述:IC FIFO 8192X18 4NS 144BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標準包裝:15 系列:74F 功能:異步 存儲容量:256（64 x 4） 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP（0.300"，7.62mm） 供應商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433
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