IDT72T1845/55/65/75/85/95/105/115/125 2.5V TeraSync 18-BIT/9-BIT FIFO
參數(shù)資料
型號： IDT72T18115L6-7BB
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 37/55頁
文件大?。?/td> 0K
描述： IC FIFO 262KX18 6-7NS 240BGA
標準包裝： 1
系列： 72T
功能： 異步
存儲容量： 4.7Mb（262k x 18）
數(shù)據(jù)速率： 10MHz
訪問時間： 3.8ns
電源電壓： 2.375 V ~ 2.625 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 240-BGA
供應(yīng)商設(shè)備封裝： 240-PBGA（19x19）
包裝： 托盤
其它名稱： 72T18115L6-7BB
42
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
IDT72T1845/55/65/75/85/95/105/115/125 2.5V TeraSync 18-BIT/9-BIT FIFO 2Kx18/4Kx9, 4Kx18/
8Kx9, 8Kx18/16Kx9, 16Kx18/32Kx9, 32Kx18/64Kx9, 64Kx18/128Kx9, 128Kx18/256Kx9, 256Kx18/512Kx9, 512Kx18/1Mx9
FEBRUARY 10, 2009
tREF
tENS
tENH
5909
drw22
tENS
W
MK-1
WCLK
RCLK
REN
RT
EF
PAF
HF
PAE
Q
n
12
1
tPAFS
tREF
2
WEN
tENS
tA
tENS
W
MK
W
MK+1
tA
W
MK+n
tA
W
MK
W
MK+1
tA
tENS
MARK
tENH
tENS
tPAES
(6)
tA
tSKEW2
tHF
3
Figure
18.
Retransmit
from
Mark
(IDT
Standard
Mode)
NOTES:
1
.
Retransmit
setup
is
complete
when
EF
returns
HIGH.
2.
OE
=
LOW;
RCS
=
LOW.
3.
RT
must
be
HIGH
when
reading
from
FIFO.
4
.
Once
Mark
is
set,
the
write
pointer
will
not
increment
past
the
‘marked’
location,
preventing
overwrites
of
Retransmit
data.
5
.
Before
a
“MARK”
can
be
set
there
must
be
at
least
32
bytes
of
data
between
the
Write
Pointer
and
Read
Pointer
locations
for
t
he
IDT72T1845/72T1855/72T1865/72T1875/72T1885/72T1895,
64
bytes
of
data
for
the
IDT72T18105/
72T18115
and
128
bytes
of
data
for
the
IDT72T18125.
(32
bytes
=
16
words
=
8
long
words).
6
.
A
transition
in
the
PAE
flag
may
occur
one
RCLK
cycle
earlier
than
shown,
(on
cycle
2).
相關(guān)PDF資料
PDF描述
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IDT72T18125L5BBGI 制造商:Integrated Device Technology Inc 功能描述:IC FIFO 524X18 2.5V 5NS 240BGA
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