IDT72T1845/55/65/75/85/95/105/115/125 2.5V TeraSync 18-BIT/9-BIT FIFO
參數(shù)資料
型號: IDT72T18115L10BB
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 28/55頁
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描述: IC FIFO 262KX18 2.5V 10NS 240BGA
標(biāo)準(zhǔn)包裝: 1
系列: 72T
功能: 異步
存儲容量: 4.7Mb(262k x 18)
數(shù)據(jù)速率: 10MHz
訪問時間: 10ns
電源電壓: 2.375 V ~ 2.625 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 240-BGA
供應(yīng)商設(shè)備封裝: 240-PBGA(19x19)
包裝: 托盤
其它名稱: 72T18115L10BB
34
COMMERCIALANDINDUSTRIAL
TEMPERATURERANGES
IDT72T1845/55/65/75/85/95/105/115/125 2.5V TeraSync 18-BIT/9-BIT FIFO 2Kx18/4Kx9, 4Kx18/
8Kx9, 8Kx18/16Kx9, 16Kx18/32Kx9, 32Kx18/64Kx9, 64Kx18/128Kx9, 128Kx18/256Kx9, 256Kx18/512Kx9, 512Kx18/1Mx9
FEBRUARY 10, 2009
Figure 9. Master Reset Timing
5909 drw13
RT
SEN
tRSF
OE = HIGH
OE = LOW
PAE
PAF, HF
Q0 - Qn
tRSF
EF/OR
FF/IR
tRSF
If FWFT = HIGH,
OR = HIGH
If FWFT = LOW,
EF = LOW
If FWFT = LOW,
FF = HIGH
If FWFT = HIGH,
IR = LOW
tRSS
PFM
tHRSS
IP
tRS
MRS
tRSR
REN
tRSS
FWFT/SI
tRSR
WEN
FSEL0,
FSEL1
OW, IW
BE
LD
tRSR
tRSS
WHSTL
RHSTL
SHSTL
tRSS
tHRSS
NOTE:
1. During Master Reset the High-Impedance control of the Qn data outputs is provided by
OE only, RCS can be HIGH or LOW until the first rising edge of RCLK after Master Reset
is complete.
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IDT72T18115L5BB 功能描述:IC FIFO 262KX18 2.5V 5NS 240BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256(64 x 4) 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP(0.300",7.62mm) 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433
IDT72T18115L5BBGI 制造商:Integrated Device Technology Inc 功能描述:IC FIFO 262KX18 2.5V 5NS 240BGA
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IDT72T18115L6-7BB 功能描述:IC FIFO 262KX18 6-7NS 240BGA RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:72T 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲容量:256(64 x 4) 數(shù)據(jù)速率:- 訪問時間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:24-DIP(0.300",7.62mm) 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱:74F433