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參數(shù)資料
| 型號： | IDT7290820PQF |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 路由/交換 |
| 英文描述： | TIME SLOT INTERCHANGE DIGITAL SWITCH 2,048 x 2,048 |
| 中文描述： | TELECOM, DIGITAL TIME SWITCH, PQFP100 |
| 封裝： | 14 X 20 MM, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 20/27頁 |
| 文件大?。?/td> | 174K |
| 代理商： | IDT7290820PQF |
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20
COMMERCIAL TEMPERATURE RANGE
IDT7290820 5V TIME SLOT INTERCHANGE
DIGITAL SWITCH 2,048 x 2,048
$1
NOTE:
1. High Impedance is measured by pulling to the appropriate rail with R
L
, with timng corrected to cancel time taken to discharge C
L
.
Symbol
t
FPW
Characteristics
Frame Pulse Width (ST-BUS
, GCI)
Min.
26
26
26
10
16
190
110
55
85
50
20
85
50
20
195
10
20
190
85
85
-10
Typ.
Max.
295
145
80
300
150
70
150
75
40
150
75
40
10
295
150
150
300
150
150
10
10
Units
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Bit rate = 2.048 Mb/s
Bit rate = 4.096 Mb/s
Bit rate = 8.192 Mb/s
t
FPS
t
FPH
t
CP
Frame Pulse Setup time before CLK falling (ST-BUS
or GCI)
Frame Pulse Hold Time fromCLK falling (ST-BUS
or GCI)
CLK Period
Bit rate = 2.048 Mb/s
Bit rate = 4.096 Mb/s
Bit rate = 8.192 Mb/s
Bit rate = 2.048 Mb/s
Bit rate = 4.096 Mb/s
Bit rate = 8.192 Mb/s
Bit rate = 2.048 Mb/s
Bit rate = 4.096 Mb/s
Bit rate = 8.192 Mb/s
t
CH
CLK Pulse Width HIGH
t
CL
CLK Pulse Width LOW
t
r
, t
f
t
HFPW
t
HFPS
t
HFPH
t
HCP
t
HCH
t
HCL
t
Hr
, t
Hf
t
DIF
Clock Rise/Fall Time
Wide Frame Pulse Width
Frame Pulse Setup Time before HCLK falling
Frame Pulse Hold Time fromHCLK falling
HCLK (4.096 MHz) Period
HCLK (4.096 MHz) Pulse Width HIGH
HCLK (4.096 MHz) Pulse Width LOW
HCLK Rise/Fall Time
Delay between falling edge of HCLK and falling edge of CLK
Bit rate = 8.192 Mb/s
Bit rate = 8.192 Mb/s
Bit rate = 8.192 Mb/s
Bit rate = 8.192 Mb/s
Symbol
t
SIS
t
SIH
t
SOD
Characteristics
RX Setup Time
RX Hold Time
TX Delay – Active to Active
Min.
0
20
Typ.
Max.
39
58
37
37
37
48
58
Unit
ns
ns
ns
ns
ns
ns
ns
ns
ns
Test Conditions
C
L
= 30pF
C
L
= 200pF
t
DZ
t
ZD
t
ODE
t
XCD
TX Delay – Active to High-Z
TX Delay – High-Z to Active
Output Driver Enable (ODE) Delay
CCO Output Delay
R
L
= 1K
, C
L
= 200pF
R
L
= 1K
, C
L
= 200pF
R
L
= 1K
, C
L
= 200pF
C
L
= 30pF
C
L
= 200pF
$1
"
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