IDT723652/723662/723672 CMOS SyncBiFIFOTM 2,048 x 36 x 2, 4,096 x 36 x 2 " />
參數(shù)資料
型號(hào): IDT723662L12PF8
廠商: IDT, Integrated Device Technology Inc
文件頁(yè)數(shù): 13/29頁(yè)
文件大?。?/td> 0K
描述: IC FIFO BI SYNC 8192X36 120QFP
標(biāo)準(zhǔn)包裝: 750
系列: 7200
功能: 同步
存儲(chǔ)容量: 288K(8K x 36)
數(shù)據(jù)速率: 83MHz
訪(fǎng)問(wèn)時(shí)間: 12ns
電源電壓: 4.5 V ~ 5.5 V
工作溫度: 0°C ~ 70°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 120-LQFP
供應(yīng)商設(shè)備封裝: 120-TQFP(14x14)
包裝: 帶卷 (TR)
其它名稱(chēng): 723662L12PF8
20
COMMERCIALTEMPERATURERANGE
IDT723652/723662/723672 CMOS SyncBiFIFOTM
2,048 x 36 x 2, 4,096 x 36 x 2 and 8,192 x 36 x 2
NOTE:
1. tSKEW1 is the minimum time between a rising CLKB edge and a rising CLKA edge for
EFA to transition HIGH in the next CLKA cycle. If the time between the rising CLKB edge and rising
CLKA edge is less than tSKEW1, then the transition of
EFA HIGH may occur one CLKA cycle later than shown.
Figure 11.
EFA
EFA Flag Timing and First Data Read when FIFO2 is Empty (IDT Standard Mode)
CSB
W/RB
MBB
FFB
B0-B35
CLKA
EFA
CSA
W/RA
MBA
ENB
ENA
A0-A35
CLKB
12
5609 drw13
tCLKH
tCLKL
tCLK
tENS2
tENH
tDS
tDH
tSKEW1
(1)
tCLK
tCLKL
tENS2
tENH
tA
W1
FIFO2 Empty
LOW
tCLKH
W1
HIGH
tPOR
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PDF描述
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參數(shù)描述
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IDT723662L15PQF 功能描述:IC FIFO BI SYNC 8192X36 132QFP RoHS:否 類(lèi)別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標(biāo)準(zhǔn)包裝:15 系列:74F 功能:異步 存儲(chǔ)容量:256(64 x 4) 數(shù)據(jù)速率:- 訪(fǎng)問(wèn)時(shí)間:- 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類(lèi)型:通孔 封裝/外殼:24-DIP(0.300",7.62mm) 供應(yīng)商設(shè)備封裝:24-PDIP 包裝:管件 其它名稱(chēng):74F433
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