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參數(shù)資料
| 型號： | IDT723646L15PF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 20/35頁 |
| 文件大小： | 0K |
| 描述： | IC FIFO SYNC 2048X36 128QFP |
| 標準包裝： | 72 |
| 系列： | 7200 |
| 功能： | 同步 |
| 存儲容量： | 72K（2K x 36） |
| 數(shù)據(jù)速率： | 67MHz |
| 訪問時間： | 15ns |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 128-LQFP |
| 供應商設備封裝： | 128-TQFP（14x20） |
| 包裝： | 托盤 |
| 其它名稱： | 723646L15PF |
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27
IDT723626/723636/723646 CMOS TRIPLE BUS SyncFIFO
WITH BUS-MATCHING 256 x 36 x 2, 512 x 36 x 2 and 1,024 x 36 x 2
COMMERCIAL TEMPERATURE RANGE
NOTES:
1. tSKEW1 is the minimum time between a rising CLKC edge and a rising CLKA edge for
EFA to transition HIGH in the next CLKA cycle. If the time between the rising CLKC edge
and rising CLKA edge is less than tSKEW1, then the transition of
EFA HIGH may occur one CLKA cycle later than shown.
2. If Port C size is word or byte, tSKEW1 is referenced to the rising CLKC edge that writes the last word or byte of the long word, respectively.
Figure 19.
EFA
EFA Flag Timing and First Data Read when FIFO2 is Empty (IDT Standard Mode)
MBC
FFC
C0-C17
CLKA
EFA
CSA
W/RA
MBA
WENC
ENA
A0-A35
CLKC
12
3271 drw20
tCLKH
tCLKL
tCLK
tENS2
tENH
tDS
tDH
tSKEW1
tCLK
tCLKL
tENS2
tENH
tA
W1
FIFO2 Empty
LOW
tCLKH
HIGH
(1)
tREF
tDH
tDS
Write 1
Write 2
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PDF描述 |
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| IDT723651L15PF8 | 功能描述:IC FIFO SYNC 2048X36 120QFP RoHS:否 類別:集成電路 (IC) >> 邏輯 - FIFO 系列:7200 標準包裝:90 系列:7200 功能:同步 存儲容量:288K（16K x 18） 數(shù)據(jù)速率:100MHz 訪問時間:10ns 電源電壓:4.5 V ~ 5.5 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:64-LQFP 供應商設備封裝:64-TQFP（14x14） 包裝:托盤 其它名稱:72271LA10PF |
| IDT723651L15PFG | 制造商:Integrated Device Technology Inc 功能描述:IC FIFO SYNC 2048X36 120QFP |
| IDT723651L15PFG8 | 制造商:Integrated Device Technology Inc 功能描述:IC FIFO SYNC 2048X36 120QFP |
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