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參數(shù)資料
| 型號： | IDT723613L30PF |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | CMOS Clocked FIFO With Bus Matching and Byte Swapping 64 x 36 |
| 中文描述： | 64 X 36 OTHER FIFO, 15 ns, PQFP120 |
| 封裝： | TQFP-120 |
| 文件頁數(shù)： | 23/26頁 |
| 文件大?。?/td> | 193K |
| 代理商： | IDT723613L30PF |
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23
COMMERCIAL AND INDUSTRIAL
TEMPERATURE RANGES
IDT723613 CMOS CLOCKED FIFO WITH
BUS-MATCHING AND BYTE SWAPPING 64 x 36
3145 drw15
CLKB
ENB
B0 - B35
SIZ1,
SIZ0
CSB
W/
R
B
CLKA
MBF2
CSA
MBA
ENA
A0 - A35
W/
R
A
W1
t
ENS
t
ENH
t
DH
t
ENH
t
EN
W1 (Remains valid in Mail2 Register after read)
t
SZS
t
SZH
t
ENS
t
ENH
t
ENS
t
ENH
t
DS
t
PMF
t
PMF
t
ENS
t
PMR
t
DIS
NOTE
:
1. Port-A parity generation off (PGA = LOW).
Figure 15. Timing for Mail2 Register and
MBF2
Flag
ODD/
EVEN
PEFA
PGA
MBA
W/
R
A
3145 drw16
Valid
Valid
Valid
Valid
t
POPE
t
PEPE
t
POPE
t
PEPE
NOTE:
1.
CSA
= LOW and ENA = HIGH.
Figure 16. ODD/
EVEN
, W/
R
A, MBA, and PGA to
PEFA
Timing
Figure 17. ODD/
EVEN
, W/
R
B
,
SIZ1, SIZ0, and PGB to
PEFB
Timing
ODD/
EVEN
PEFB
PGB
SIZ1,
SIZ0
W/
R
B
3145 drw17
Valid
Valid
Valid
Valid
t
POPE
t
PEPE
t
POPE
t
PEPE
NOTE:
1.
CSB
= LOW and ENB = HIGH.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IDT723613L30PQF | CMOS Clocked FIFO With Bus Matching and Byte Swapping 64 x 36 |
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參數(shù)描述 |
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