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參數(shù)資料
| 型號(hào)： | IDT5V2310PGI |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類(lèi)： | 時(shí)鐘及定時(shí) |
| 英文描述： | 2.5V TO 3.3V HIGH PERFORMANCE CLOCK BUFFER |
| 中文描述： | 5V SERIES, LOW SKEW CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO24 |
| 封裝： | TSSOP-24 |
| 文件頁(yè)數(shù)： | 6/8頁(yè) |
| 文件大小： | 57K |
| 代理商： | IDT5V2310PGI |
6
INDUSTRIAL TEMPERATURE RANGE
IDT5V2310
2.5V TO 3.3V HIGH PERFORMANCE CLOCK BUFFER
OUTPUT ENABLE GLITCH SUPPRESSION CIRCUIT
The purpose of the glitch suppression circuitry is to ensure the output enable sequence is synchronized with the clock input such that the output buffer will be
enabled on the next full period of the input clock (negative edge triggered by the input clock). The G input must be stable one t
EN
- time prior to the falling edge
of the CLK for predictable operation.
CLK
t
EN
t
DIS
Gx
Yx
G (t
EN
, t
DIS
) Relative to CLK
↓
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PDF描述 |
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參數(shù)描述 |
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| IDT5V2528APGGI | 功能描述:IC CLK DVR ZD BUFFER PLL 28TSSOP RoHS:是 類(lèi)別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:1,000 系列:- 類(lèi)型:時(shí)鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類(lèi)型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤(pán) 供應(yīng)商設(shè)備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱(chēng):844S012AKI-01LFT |
| IDT5V2528APGGI8 | 功能描述:IC CLK DVR ZD BUFFER PLL 28TSSOP RoHS:是 類(lèi)別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:1,000 系列:- 類(lèi)型:時(shí)鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類(lèi)型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤(pán) 供應(yīng)商設(shè)備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱(chēng):844S012AKI-01LFT |
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