參數(shù)資料
型號: IDT5V2310PGI
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 時鐘及定時
英文描述: 2.5V TO 3.3V HIGH PERFORMANCE CLOCK BUFFER
中文描述: 5V SERIES, LOW SKEW CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO24
封裝: TSSOP-24
文件頁數(shù): 3/8頁
文件大小: 57K
代理商: IDT5V2310PGI
3
INDUSTRIAL TEMPERATURE RANGE
IDT5V2310
2.5V TO 3.3V HIGH PERFORMANCE CLOCK BUFFER
Symbol
V
DD
Description
Internal Power Supply Voltage
Min.
2.3
Typ.
2.5
3.3
Max.
Unit
V
3.6
0.8
0.7
V
IL
Input Voltage LOW
V
DD
= 3V to 3.6V
V
DD
= 2.3V to 2.7V
V
DD
= 3V to 3.6V
V
DD
= 2.3V to 2.7V
V
V
IH
Input Voltage HIGH
2
V
1.7
0
V
I
I
OH
Input Voltage
Output Current HIGH
V
DD
-12
-6
12
6
+85
V
V
DD
= 3V to 3.6V
V
DD
= 2.3V to 2.7V
V
DD
= 3V to 3.6V
V
DD
= 2.3V to 2.7V
mA
I
OL
Output Current LOW
mA
T
A
Ambient Operating Temperature
-40
°C
RECOMMENDED OPERATING RANGE
NOTE:
1. All typical values are at respective nomnal V
DD
.
DC ELECTRICAL CHARACTERISTICS - V
DD
= 3.3V ± 0.3V
Symbol
Parameter
Test Conditions
Min.
V
DD
- 0.2
2.1
2.4
Typ.
(1)
Max
Unit
V
DD
= Mn. to Max.
V
DD
= 3V
I
OH
= -100
μ
A
I
OH
= -12mA
I
OH
= -6mA
I
OH
= 100
μ
A
I
OH
= 12mA
I
OH
= 6mA
V
O
= 1V
V
O
= 1.65V
V
O
= 3.135V
V
O
= 1.95V
V
O
= 1.65V
V
O
= 0.4V
V
OH
HIGH level Output Voltage
V
V
DD
= Mn. to Max.
V
DD
= 3V
0.2
0.8
0.55
V
OL
LOW level Output Voltage
V
V
DD
= 3V
V
DD
= 3.3V
V
DD
= 3.6V
V
DD
= 3V
V
DD
= 3.3V
V
DD
= 3.6V
-28
I
OH
HIGH level Output Current
-36
mA
-14
28
I
OL
LOW level Output Current
36
mA
14
NOTE:
1. For I
DD
over frequency, see TEST CIRCUIT AND WAVEFORMS.
DC ELECTRICAL CHARACTERISTICS OV ER OPERATING RANGE
Symbol
Parameter
V
IK
Input Voltage
V
DD
= 3V, I
IN
= -18mA
I
IN
Input Current
V
I
= 0V or V
DD
I
DD
Static Device Current
(1)
CLK = 0V or V
DD
, I
O
= 0mA, V
DD
= 3.3V
Test Conditions
Min.
Typ.
Max
- 1.2
±5
25
Unit
V
μ
A
μ
A
PIN DESCRIPTION
TERMINAL
Symbol
I/O
1G
I
Description
Output Enable Control for
1
Y
(0:4)
Outputs. This output enable is active HIGH. If this pin is Logic HIGH, the
1
Y
(0:4)
clock outputs will follow the
input clock (CLK). If this pin is logic LOW, the
1
Y
(0:4)
outputs will drive low independent of the state of CLK.
Output Enable Control for
2
Y
(0:4)
Outputs. This output enable is active HIGH. If this pin is Logic HIGH, the
2
Y
(0:4)
clock outputs will follow the
input clock (CLK). If this pin is logic LOW, the
2
Y
(0:4)
outputs will drive low independent of the state of CLK.
Buffered Output Clocks
Buffered Output Clocks
Input Reference Frequency
Ground
DC Power Supply, 2.3V to 3.6V
2G
I
1
Y
(0:4)
2
Y
(0:4)
CLK
GND
V
DD
O
O
I
PWR
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PDF描述
IDT5V2528A 2.5V / 3.3V PHASE-LOCK LOOP CLOCK DRIVER ZERO DELAY BUFFER
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IDT5V2528PG 2.5V / 3.3V PHASE-LOCK LOOP CLOCK DRIVER ZERO DELAY BUFFER
IDT5V2528PGG 2.5V / 3.3V PHASE-LOCK LOOP CLOCK DRIVER ZERO DELAY BUFFER
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