參數(shù)資料
型號(hào)： ICS954201YFLNT
英文描述： Programmable Timing Control Hub⑩ for Mobile P4⑩ Systems
中文描述： 可編程定時(shí)控制中心，對(duì)移動(dòng)P4⑩⑩系統(tǒng)
文件頁(yè)數(shù)： 1/15頁(yè)
文件大小： 157K
代理商： ICS954201YFLNT
Integrated
Circuit
Systems, Inc.
ICS954201
0819G—12/06/04
Pin Configuration
Recommended Application:
CK410M clock, Intel Yellow Cover part
Output Features:
2 - 0.7V current-mode differential CPU pairs
7 - 0.7V current-mode differential SRC pair for SATA and
PCI-E
1 - 0.7V current-mode differential CPU/SRC selectable
pair
4 - PCI (33MHz)
2 - PCICLK_F, (33MHz) free-running
1 - USB, 48MHz
1 - DOT, 96MHz, 0.7V current differential pair
1 - REF, 14.318MHz
Key Specifications:
CPU outputs cycle-cycle jitter < 85ps
SRC outputs cycle-cycle jitter < 125ps
PCI outputs cycle-cycle jitter < 500ps
+/- 300ppm frequency accuracy on CPU & SRC clocks
+/- 100ppm frequency accuracy on USB clocks
Programmable Timing Control Hub for Mobile P
4
Systems
Functionality
Features/Benefits:
Supports tight ppm accuracy clocks for Serial-ATA and
PCI-Express
Supports spread spectrum modulation, 0 to -0.5%
down spread
Supports CPU clocks up to 400MHz
Uses external 14.318MHz crystal, external crystal load
caps are required for frequency tuning
Supports undriven differential CPU, SRC pair in PD#
for power management.
56-pin SSOP & TSSOP
VDDPCI 1
GND 2
PCICLK3 3
PCICLK4 4
PCICLK5 5
GND 6
VDDPCI 7
56 PCICLK2
55 PCI/SRC_STOP#
54 CPU_STOP#
53 FS_C/TEST_SEL
52 REFOUT
51 GND
50 X1
49 X2
48 VDDREF
47 SDATA
46 SCLK
45 GND
44 CPUCLKT0
43 CPUCLKC0
42 VDDCPU
41 CPUCLKT1
40 CPUCLKC1
39 IREF
38 GNDA
37 VDDA
36 CPUCLKT2_ITP/SRCCLKT7
35 CPUCLKC2_ITP/SRCCLKC7
34 VDDSRC
33 SRCCLKT6
32 SRCCLKC6
31 SRCCLKT5
30 SRCCLKC5
29 GND
ITP_EN/PCICLK_F0 8
PCICLK_F1 9
Vtt_PwrGd#/PD 10
VDD48 11
USB_48MHz/FS_A 12
GND 13
DOTT_96MHz 14
DOTC_96MHz 15
FS_B/TEST_MODE 16
SRCCLKT0 17
SRCCLKC0 18
SRCCLKT1 19
SRCCLKC1 20
VDDSRC 21
SRCCLKT2 22
SRCCLKC2 23
SRCCLKT3 24
SRCCLKC3 25
SRCCLKT4_SATA 26
SRCCLKC4_SATA 27
VDDSRC 28
I
FS_C
1
FS_B
2
FS_A
2
CPU
MHz
266.66
133.33
200.00
166.66
333.33
100.00
400.00
SRC
MHz
100.00
100.00
100.00
100.00
100.00
100.00
100.00
PCI
MHz
33.33 14.318
33.33 14.318
33.33 14.318
33.33 14.318
33.33 14.318
33.33 14.318
33.33 14.318
REF
MHz
U
SB
MHz
48.00
48.00
48.00
48.00
48.00
48.00
48.00
48.00
DOT
MHz
96.00
96.00
96.00
96.00
96.00
96.00
96.00
96.00
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
14.318
1. FS_C is a three-level input. Please see V
IL_FS
and V
IH_FS
specifications in
the Input/Supply/Common Output Parameters Table for correct values.
Also refer to the Test Clarification Table.
2. FS_B and FS_A are low-threshold inputs. Please see the V
IL_FS
and V
IH_FS
specifications in the Input/Supply/Common Output Parameters Table for correct values.
RESERVED
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PDF描述
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ICS954204 16-Bit Registered Transceivers With 3-State Outputs 56-SSOP -40 to 85
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參數(shù)描述
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