參數(shù)資料
型號： ICS950202YFT
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時鐘產(chǎn)生/分配
英文描述： 200 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
封裝： 0.300 INCH, MO-118, SSOP-48
文件頁數(shù)： 9/20頁
文件大小： 223K
代理商： ICS950202YFT
17
Integrated
Circuit
Systems, Inc.
ICS950202
0461M—02/10/06
All 3V66 clocks are to be in pphase with each other. In the case where 3V66_1 is configured as 48MHz VCH clock, there is no
defined phase relationship between 3V66_1/VCH and other 3V66 clocks. The PCI group should lag 3V66 by the standard skew
described below as Tpci.
3V66 & PCI Phase Relationship
3V66 (1:0)
3V66 (4:2)
3V66_5
PCICLK_F (2:0) PCICLK (6:0)
Tpci
PD# Functionality
#
P
O
T
S
_
U
P
CT
U
P
CC
U
P
C6
6
V
3T
U
O
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M
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M
*
f
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it
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Fw
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Lw
o
Lw
o
Lw
o
Lw
o
L
Group Skews at Common Transition Edges
GROUP
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
3V66
3V66 (5:0) pin to pin skew
0
500
ps
PCI
PCI_F (2:0) and PCI (6:0) pin to pin skew
0
500
ps
3V66 to PCI
S3V66-PCI
3V66 (5:0) leads 33MHz PCI
1.5
3.5
ns
1Guarenteed by design, not 100% tested in production.
相關(guān)PDF資料
PDF描述
ICS950208YFLFT 200.4 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
ICS950211YF-T 205 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
ICS950211YFLF-T 205 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
ICS950218YFT 200.4 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
ICS950219YFLF-T 200.4 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
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參數(shù)描述
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