參數(shù)資料
型號(hào)： ICS93732G-T
英文描述： Low Cost DDR Phase Lock Loop Zero Delay Buffer
中文描述： 低成本的DDR鎖相環(huán)零延遲緩沖器
文件頁(yè)數(shù)： 6/8頁(yè)
文件大?。?/td> 491K
代理商： ICS93732G-T
6
ICS93732
0578H—02/19/04
Bytes 0 to 4 are reseved power up default = 1. This allows operation with main clock.
Pin #
2, 1
4, 5
-
-
13, 14
17, 16
-
-
PWD = Power Up Default
Name
0
1
PWD
1
1
1
1
1
1
1
1
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Note:
DDR0(T&C)
DDR1(T&C)
-
-
DDR2(T&C)
DDR3(T&C)
-
-
Output Control
Output Control
Reserved
Reserved
Output Control
Output Control
Reserved
Reserved
RW
RW
X
X
RW
RW
X
X
DISABLE ENABLE
DISABLE ENABLE
-
-
DISABLE ENABLE
DISABLE ENABLE
-
-
-
-
-
-
Pin #
-
-
-
-
24, 25
-
26, 27
-
PWD = Power Up Default
Name
-
-
-
-
0
-
-
-
-
1
-
-
-
-
PWD
0
0
0
1
1
1
1
1
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Note:
Reserved
Reserved
Reserved
Reserved
Output Control
Reserved
Output Control
Reserved
X
X
X
X
DDR4(T&C)
-
DDR5(T&C)
-
RW
X
RW
X
DISABLE ENABLE
-
DISABLE ENABLE
-
-
-
Control Function
Affected Pin
BYTE
5
BYTE
6
Type
Bit Control
Type
Control Function
Affected Pin
Bit Control
相關(guān)PDF資料
PDF描述
ICS93732 Low Cost DDR Phase Lock Loop Zero Delay Buffer
ICS93732FLF-T Low Cost DDR Phase Lock Loop Zero Delay Buffer
ICS93735 DDR Phase Lock Loop Zero Delay Clock Buffer
ICS93735F-T DDR Phase Lock Loop Zero Delay Clock Buffer
ICS93738 DDR and SDRAM Buffer
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參數(shù)描述
ICS93735 制造商:ICS 制造商全稱:ICS 功能描述:DDR Phase Lock Loop Zero Delay Clock Buffer
ICS93735F-T 制造商:ICS 制造商全稱:ICS 功能描述:DDR Phase Lock Loop Zero Delay Clock Buffer
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