參數(shù)資料
型號: ICS87973DYIT
元件分類: 時鐘及定時
英文描述: PLL BASED CLOCK DRIVER, 13 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52
封裝: 10 X 10 MM, 1.40 MM HEIGHT, MS-026, LQFP-52
文件頁數(shù): 16/16頁
文件大小: 170K
代理商: ICS87973DYIT
87973DYI
www.icst.com/products/hiperclocks.html
REV. D MAY 19, 2006
9
Integrated
Circuit
Systems, Inc.
ICS87973I
LOW SKEW, 1-TO-12
LVCMOS / LVTTL CLOCK MULTIPLIER/ZERO DELAY BUFFER
PARAMETER MEASUREMENT INFORMATION
3.3V OUTPUT LOAD AC TEST CIRCUIT
SCOPE
Qx
LVCMOS
1.65V±5%
-1.65V±5%
DIFFERENTIAL INPUT LEVEL
CYCLE-TO-CYCLE JITTER
OUTPUT SKEW
STATIC PHASE OFFSET (LVCMOS)
tsk(o)
V
DDO
2
V
DDO
2
Qy
Qx
t
PW
t
PERIOD
V
DDO
2
V
DDO
2
V
DDO
2
t
PW
t
PERIOD
odc =
QA0:QA3,
QB0:QB3,
QC0:QC3,
QSYNC,
QFB
QA0:QA3,
QB0:QB3,
QC0:QC3,
QSYNC,
QFB
V
DDO
2
V
DDO
2
V
DDO
2
tcycle n
tcycle n+1
t jit(cc) = tcycle n –tcycle n+1
1000 Cycles
Clock
Outputs
0.5V
2.4V
0.5V
tR
t F
t()
V
DD
2
V
DD
2
(where t() is any random sample, and t() mean is the average
of the sampled cycles measured on controlled edges)
t() mean = Static Phase Offset
OUTPUT RISE/FALL TIME
t
PW & tPeriod
STATIC PHASE OFFSET (DIFFERENTIAL)
CLK0,
CLK1
EXT_FB
nCLK
EXT_FB
CLK
t()
V
DD
2
(where t() is any random sample, and t() mean is the average
of the sampled cycles measured on controlled edges)
t() mean = Static Phase Offset
V
CMR
Cross Points
V
PP
nCLK
CLK
GND
V
DD
V
DD,
V
DDA, VDDO
GND
相關PDF資料
PDF描述
ICS87974AY-01LF PLL BASED CLOCK DRIVER, 15 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52
ICS87974AYI-01 PLL BASED CLOCK DRIVER, 14 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52
ICS87974AYI-01LFT PLL BASED CLOCK DRIVER, 14 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52
ICS87974AYI PLL BASED CLOCK DRIVER, 14 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52
ICS87974AYI PLL BASED CLOCK DRIVER, 14 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52
相關代理商/技術參數(shù)
參數(shù)描述
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