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參數(shù)資料
| 型號： | ICS87974AYI-01 |
| 元件分類： | 時鐘及定時 |
| 英文描述： | PLL BASED CLOCK DRIVER, 14 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52 |
| 封裝： | 10 X 10 MM, 1.40 MM HEIGHT, MS-026, LQFP-52 |
| 文件頁數(shù)： | 1/15頁 |
| 文件大?。?/td> | 277K |
| 代理商： | ICS87974AYI-01 |
87974AYI-01
www.icst.com/products/hiperclocks.html
REV. A FEBRUARY 9, 2004
1
Integrated
Circuit
Systems, Inc.
ICS87974I-01
LOW SKEW, 1-TO-15,
DIFFERENTIAL-TO-LVCMOS / LVTTL CLOCK GENERATOR
GENERAL DESCRIPTION
The ICS87974I-01 is a low skew, low jitter 1-to-15
Differential-to-LVCMOS / LVTTL Clock Generator/
Zero Delay Buffer and is a member of the
HiPerClockSfamily of High Performance Clock
Solutions from ICS. The device has a fully inte-
grated PLL and three banks whose divider ratios can be
independently controlled, providing output frequency relation-
ships of 1:1, 2:1, 3:1, 3:2, 3:2:1. In addition, the external feed-
back connection provides for a wide selection of output-to-
input frequency ratios. The CLK1 and CLK0, nCLK0 pins allow
for redundant clocking on the input and dynamically switching
the PLL between two clock sources.
Guaranteed low jitter and output skew characteristics make the
ICS87974I-01 ideal for those applications demanding well de-
fined performance and repeatability.
FEATURES
Fully integrated PLL
15 single ended 3.3V LVCMOS / LVTTL outputs
Selectable CLK1 or differential CLK0, nCLK0 inputs
for redundant clock applications
CLK1 accepts LVCMOS or LVTTL input levels
CLK0, nCLK0 pair can accept the following differential
input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL
Maximum output frequency: 125MHz
VCO range: 250MHz to 500MHz
External feedback for ”zero delay” clock regeneration
Cycle-to-cycle jitter: 50ps (maximum)
Output skew: 200ps (maximum)
Bank skew: 70ps (maximum)
PLL reference zero delay: CLK1: -150ps to 150ps
CLK0, nCLK0: -475ps to -175ps
3.3V operating supply
-40°C to 70°C ambient operating temperature
HiPerClockS
ICS
PIN ASSIGNMENT
GND
nMR
CLK_EN
SEL_B
SEL_C
PLL_SEL
SEL_A
CLK_SEL
CLK1
CLK0
nCLK0
VDD
VDDA
1
2
3
4
5
6
7
8
9
10
11
12
13
14 15 16 17 18 19 20 21 22 23 24 25 26
39
38
37
36
35
34
33
32
31
30
29
28
27
52 51 50 49 48 47 46 45 44 43 42 41 40
GND
QB1
VDDOB
QB2
GND
QB3
VDDOB
QB4
FB_IN
GND
QFB
VDDOFB
nc
QB0
V
DDOB
nc
GND
QC3
V
DDOC
QC2
GND
QC1
V
DDOC
QC0
GND
VCO_SEL
ICS87974I-01
52-Lead LQFP
10mm x 10mm x 1.4mm package body
Y package
Top View
FB_SEL0
GND
QA4
V
DDOA
QA3
GND
FB_SEL1
QA2
V
DDOA
QA1
GND
QA0
V
DDOA
相關PDF資料 |
PDF描述 |
|---|---|
| ICS87974AYI-01LFT | PLL BASED CLOCK DRIVER, 14 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52 |
| ICS87974AYI | PLL BASED CLOCK DRIVER, 14 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52 |
| ICS87974AYI | PLL BASED CLOCK DRIVER, 14 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52 |
| ICS87974AYILF | PLL BASED CLOCK DRIVER, 14 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52 |
| ICS87974AYILFT | PLL BASED CLOCK DRIVER, 14 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
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