參數(shù)資料
型號： ICS854058
英文描述： DIFFERENTIAL-TO-LVDS CLOCK MULTIPLEXER
中文描述： 差分至LVDS脈多
文件頁數(shù)： 9/12頁
文件大?。?/td> 174K
代理商： ICS854058
854058AG
www.icst.com/products/hiperclocks.html
REV. A APRIL 8, 2004
9
Integrated
Circuit
Systems, Inc.
ICS854058
8:1
D
IFFERENTIAL
-
TO
-LVDS C
LOCK
M
ULTIPLEXER
PRELIMINARY
S
CHEMATIC
E
XAMPLE
An application schematic example of ICS854058 is shown
in Figure 4. The inputs can accept various types of differential
signals. In this example, the inputs are driven by LVDS drivers.
The transmission lines are assumed to be 100
differential.
The 100
matched loads termination should be located
near the receivers. It is recommended at least one
decoupling capacitor per power pin. The decoupling ca-
pacitor should be low ESR and located as close as pos-
sible to the power pin.
F
IGURE
4. ICS854058 S
CHEMATIC
E
XAMPLE
R1
100
100 Ohm Differential
Zo = 50
3.3V
VDD
U1
ICS854058
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
24
23
22
21
PCLK0
nPCLK0
PCLK1
nPCLK1
VDD
SEL0
SEL1
SEL2
PCLK2
nPCLK2
PCLK3
nPCLK3
nPCLK4
PCLK4
nPCLK5
PCLK5
GND
nQ0
VQ0
PCLK7
nPCLK7
PCLK6
nPCLK6
C2
0.1u
Zo = 50
3.3V
RU1
1K
Set Logic
Input to
'0'
C1
0.1u
LVDS
+
-
To Logic
Input
pins
100 Ohm Differential
RD1
Not Install
To Logic
Input
pins
R3
100
LVDS
Logic Control Input Examples
LVDS
Set Logic
Input to
'1'
Zo = 50
R2
100
RD2
1K
Zo = 50
VDD
Zo = 50
100 Ohm Differential
RU2
Not Install
Zo = 50
相關PDF資料
PDF描述
ICS854058AG DIFFERENTIAL-TO-LVDS CLOCK MULTIPLEXER
ICS8543 LOW SKEW, 1-TO-4 LVDS FANOUT BUFFER
ICS8543BG LOW SKEW, 1-TO-4 LVDS FANOUT BUFFER
ICS8543BGT LOW SKEW, 1-TO-4 LVDS FANOUT BUFFER
ICS8602 ZERO DELAY, DIFFERENTIAL-TO-LVCMOS/LVTTL
相關代理商/技術參數(shù)
參數(shù)描述
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