參數(shù)資料
型號(hào)： ICS853S202AYI
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時(shí)鐘及定時(shí)
英文描述： 853S SERIES, LOW SKEW CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP48
封裝： 7 X 7 MM, 1.40 MM HEIGHT, MS-026BBC, LQFP-48
文件頁數(shù)： 1/20頁
文件大?。?/td> 559K
代理商： ICS853S202AYI
12:2, DIFFERENTIAL-TO-3.3V, 2.5V
LVPECL MULTIPLEXER
ICS853S202I
IDT / ICS 3.3V, 2.5V LVPECL MULTIPLEXER
1
ICS853S202AKI REV. A JANUARY 25, 2007
PRELIMINARY
GENERAL DESCRIPTION
The ICS853S202I is an 12:1 Differential-to-3.3V
or 2.5V LVPECL Clock Multiplexer which can
operate >3GHz and is a member of the HiPerClockS
family of High Performance Clock Solutions from IDT.
The ICS853S202I has 12 selectable differential clock
inputs, any of which can be independently routed to either of the
two LVPECL outputs. The CLKx, nCLKx input pairs can accept
LVPECL, LVDS, CML or SSTL levels. The fully differential archi-
tecture and low propagation delay make it ideal for use in clock
distribution circuits.
FEATURES
High speed 12:2 differential multiplexer
Two differential 3.3V or 2.5V LVPECL output
Twelve selectable differential clock or data inputs
CLKx, nCLKx pairs can accept the following differential input
levels: LVPECL, LVDS, CML, SSTL
Maximum output frequency: >3GHz
Translates any single ended input signal to LVPECL levels with
resistor bias on nCLKx input
Propagation delay: 690ps (typical)
Input skew: TBD
Output skew: 25ps (typical)
Part-to-part skew: TBD
Additive phase jitter, RMS: 0.13ps (typical) @ 155.5MHz
Full 3.3V or 2.5V operating supply modes
-40°C to 85°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
HiPerClockS
ICS
BLOCK DIAGRAM
48 47 46 45 44 43 42 41 40 39 38 37
13 14 15 16 17 18 19 20 21 22 23 24
1
2
3
4
5
6
7
8
9
10
11
12
36
35
34
33
32
31
30
29
28
27
26
25
ICS853S202I
48-Pin LQFP
7mm x 7mm x 1.4mm
package body
Y Package
Top View
CLK2
nCLK2
SELA_0
SELA_1
VCC
QA
nQA
VEE
SELA_2
SELA_3
CLK3
nCLK3
CLK9
nCLK9
SELB_0
SELB_1
VCC
QB
nQB
VEE
SELB_2
SELB_3
CLK8
nCLK8
nCLK10
CLK10
V
EE
nCLK11
CLK11
OEB
V
CC
CLK0
nCLK0
V
EE
CLK1
nCLK1
nCLK4
CLK4
V
EE
nCLK5
CLK5
V
CC
OEA
CLK6
nCLK6
V
EE
CLK7
nCLK7
QA
nQA
OEA
QB
nQB
OEB
Pulldown
4
SELA_[3:0]
CLK0
nCLK0
SELB_[3:0]
CLK1
nCLK1
CLK2
nCLK2
CLK3
nCLK3
CLK8
nCLK8
CLK9
nCLK9
CLK10
nCLK10
CLK11
nCLK11
CLK4
nCLK4
CLK5
nCLK5
CLK6
nCLK6
CLK7
nCLK7
PIN ASSIGNMENT
The Preliminary Information presented herein represents a product in pre-production. The noted characteristics are based on initial product characterization
and/or qualification. Integrated Device Technology, Incorporated (IDT) reserves the right to change any circuitry or specifications without notice.
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