LOW SKEW, 1-
參數(shù)資料
型號(hào)： ICS852911AVILFT
廠(chǎng)商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 15/16頁(yè)
文件大?。?/td> 0K
描述： IC CLOCK BUFFER MUX 2:9 28-PLCC
標(biāo)準(zhǔn)包裝： 500
系列： HiPerClockS™
類(lèi)型： 扇出緩沖器（分配），多路復(fù)用器
電路數(shù)： 1
比率 - 輸入:輸出： 2:9
差分 - 輸入:輸出： 是/是
輸入： CML，HCSL，HSTL，LVDS，LVHSTL，LVPECL，SSTL
輸出： HSTL
頻率 - 最大： 500MHz
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 28-LCC（J 形引線(xiàn)）
供應(yīng)商設(shè)備封裝： 28-PLCC（11.5x11.5）
包裝： 帶卷 (TR)
其它名稱(chēng)： 852911AVILFT
ICS852911I
LOW SKEW, 1-TO-9
DIFFERENTIAL-TO-HSTL FANOUT BUFFER
852911AVI
www.idt.com
REV. A JANUARY 21, 2014
8
LVPECL CLOCK INPUT INTERFACE
The PECL_CLK/nPECL_CLK accepts LVPECL, CML, SSTL
and other differential signals. Both V
SWING and VOH must meet
the V
PP and VCMR input requirements. Figures 3A to 3E
show interface examples for the PECL_CLK/nPECL_CLK
input driven by the most common driver types.
The input interfaces suggested here are examples only.
If the driver is from another vendor, use their termination
recommendation. Please consult with the vendor of the
driver component to confirm the driver termination
requirements.
FIGURE 3A.
PECL_CLK/nPECL_CLK
INPUT DRIVEN BY A CML DRIVER
FIGURE 3B.
PECL_CLK/nPECL_CLK
INPUT DRIVEN BY AN SSTL DRIVER
FIGURE 3C.
PECL_CLK/nPECL_CLK
INPUT DRIVEN BY A 3.3V LVPECL DRIVER
FIGURE 3D.
PECL_CLK/nPECL_CLK
INPUT DRIVEN BY A 3.3V LVDS DRIVER
HiPerClockS
PCLK
nPCLK
PCLK/nPCLK
3.3V
R2
50
R1
50
3.3V
Zo = 50 Ohm
CML
3.3V
Zo = 50 Ohm
PCLK/nPCLK
2.5V
Zo = 60 Ohm
SSTL
HiPerClockS
PCLK
nPCLK
R2
120
3.3V
R3
120
Zo = 60 Ohm
R1
120
R4
120
2.5V
FIGURE 3E.
PECL_CLK/nPECL_CLK
INPUT DRIVEN BY A 3.3V LVPECL DRIVER
WITH
AC COUPLE
3.3V
R5
100 - 200
3.3V
HiPerClockS
PCLK
nPCLK
R1
125
PCLK/nPCLK
R2
125
R3
84
C1
C2
Zo = 50 Ohm
R4
84
Zo = 50 Ohm
R6
100 - 200
3.3V LVPECL
C2
R2
1K
R5
100
Zo =50 Ohm
3.3V
C1
R3
1K
LVDS
R4
1K
HiPerC loc kS
PC LK
nPC LK
R1
1K
Zo =50 Ohm
3.3V
PC LK /n PC LK
3.3V
HiPerC loc kS
PC LK
nPC LK
R2
84
R3
125
Input
Zo =50 Ohm
R4
125
R1
84
LVPEC L
3.3V
Zo =50 Ohm
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PDF描述
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參數(shù)描述
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