LOW SKEW, 1-
參數(shù)資料
型號: ICS852911AVILFT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 14/16頁
文件大?。?/td> 0K
描述: IC CLOCK BUFFER MUX 2:9 28-PLCC
標準包裝: 500
系列: HiPerClockS™
類型: 扇出緩沖器(分配),多路復用器
電路數(shù): 1
比率 - 輸入:輸出: 2:9
差分 - 輸入:輸出: 是/是
輸入: CML,HCSL,HSTL,LVDS,LVHSTL,LVPECL,SSTL
輸出: HSTL
頻率 - 最大: 500MHz
電源電壓: 3 V ~ 3.6 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 28-LCC(J 形引線)
供應商設(shè)備封裝: 28-PLCC(11.5x11.5)
包裝: 帶卷 (TR)
其它名稱: 852911AVILFT
ICS852911I
LOW SKEW, 1-TO-9
DIFFERENTIAL-TO-HSTL FANOUT BUFFER
852911AVI
www.idt.com
REV. A JANUARY 21, 2014
7
FIGURE 2C.
HSTL_CLK/nHSTL_CLK
INPUT DRIVEN BY 3.3V LVPECL DRIVER
FIGURE 2B. HSTL_CLK/nHSTL_CLK
INPUT DRIVEN BY 3.3V LVPECL DRIVER
FIGURE 2D.
HSTL_CLK/nHSTL_CLK
INPUT DRIVEN BY 3.3V LVDS DRIVER
3.3V
R1
50
R3
50
Zo = 50 Ohm
LVPECL
Zo = 50 Ohm
HiPerClockS
CLK
nCLK
3.3V
Input
R2
50
Zo = 50 Ohm
Input
HiPerClockS
CLK
nCLK
3.3V
R3
125
R2
84
Zo = 50 Ohm
3.3V
R4
125
LVPECL
R1
84
3.3V
DIFFERENTIAL CLOCK INPUT INTERFACE
The HSTL_CLK/nHSTL_CLK accepts LVDS, LVPECL, HSTL,
SSTL, HCSL and other differential signals. Both V
SWING and
V
OH must meet the VPP and VCMR input requirements. Figures
2A to 2E show interface examples for the HSTL_CLK/
nHSTL_CLK input driven by the most common driver types.
The input interfaces suggested here are examples only.
FIGURE 2A.
HSTL_CLK/nHSTL_CLK
INPUT DRIVEN BY HSTL DRIVER
Please consult with the vendor of the driver component to
confirm the driver termination requirements. For example
in
Figure 2A, the input termination applies for HSTL
drivers. If you are using an HSTL driver from another
vendor, use their termination recommendation.
1.8V
R2
50
Input
LVHSTL Driver
ICS
HiPerClockS
R1
50
LVHSTL
3.3V
Zo = 50 Ohm
HiPerClockS
CLK
nCLK
FIGURE 2E.
HSTL_CLK/nHSTL_CLK
INPUT DRIVEN BY 3.3V LVPECL DRIVER WITH
AC COUPLE
Zo = 50 Ohm
R3
125
HiPerClockS
CLK
nCLK
3.3V
R5
100 - 200
3.3V
R2
84
3.3V
R6
100 - 200
Input
R5,R6 locate near the driver pin.
Zo = 50 Ohm
R1
84
R4
125
C2
LVPECL
C1
Zo =50 Ohm
R1
100
3.3V
LVDS_Driv er
Zo =50 Ohm
Rec eiv er
CLK
nC LK
3.3V
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