參數(shù)資料
型號: ICS843201AG-375T
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 時鐘產(chǎn)生/分配
英文描述: 375 MHz, OTHER CLOCK GENERATOR, PDSO16
封裝: 4.40 X 5 MM, 0.92 MM HEIGHT, MO-153, TSSOP-16
文件頁數(shù): 1/18頁
文件大?。?/td> 713K
代理商: ICS843201AG-375T
FEMTOCLOCKS CRYSTAL-TO-LVPECL
375MHZ, FREQUENCY MARGINING SYNTHESIZER
ICS843201-375
IDT / ICS LVPECL FREQUENCY MARGINING SYNTHESIZER
1
ICS843201AG-375 REV. A NOVEMBER 20, 2006
GENERAL DESCRIPTION
The ICS843201-375 is a lo w phase-noise
frequency margining synthesiz er and is a
member of the HiPerClock S family of high
perfor mance clock solutions from IDT. In the
default mode, the device nominally generates a
375MHz LVPECL output clock signal from a
25MHz crystal input. There is also a frequency margining
mode available where the device can be configured, using
control pins, to var y the output frequency up or down from
nominal by 5%. The ICS843201-375 is provided in a 16-pin
TSSOP package.
FEATURES
One 375MHz nominal LVPECL output
Crystal oscillator interface designed for 25MHz, 18pF parallel
resonant crystal
Output frequency can be varied ± 5% from nominal
VCO range: 700MHz - 800MHz
RMS phase jitter @ 375MHz, using a 25MHz crystal
(12kHz - 20MHz): 0.72ps (typical) @ 3.3V
Output supply modes
Core/Output
3.3V/3.3V
3.3V/2.5V
2.5V/2.5V
0°C to 70°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
HiPerClockS
ICS
BLOCK DIAGRAM
PIN ASSIGNMENT
VCC
MODE
nc
XTAL_IN
XTAL_OUT
MARGIN
VEE
nc
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
Q
nQ
VCCO
VCC
VEE
MR
nPLL_SEL
nc
ICS843201-375
16-Lead TSSOP
4.4mm x 5.0mm x 0.92mm
package body
G Package
Top View
1
0
1
Phase
Detector
VCO
700 - 800MHz
÷30
(÷57, ÷63)
OSC
Predivider
÷2
Q
nQ
Pulldown
25MHz
Pulldown
nPLL_SEL
XTAL_IN
XTAL_OUT
MODE
MARGIN
MR
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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