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參數(shù)資料
| 型號： | ICS83940DYI-01LF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 11/18頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK BUFFER MUX 2:18 32-LQFP |
| 標(biāo)準(zhǔn)包裝： | 250 |
| 系列： | HiPerClockS™ |
| 類型： | 扇出緩沖器（分配），多路復(fù)用器 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:18 |
| 差分 - 輸入:輸出： | 是/無 |
| 輸入： | CML，LVCMOS，LVPECL，LVTTL，SSTL |
| 輸出： | LVCMOS，LVTTL |
| 頻率 - 最大： | 250MHz |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應(yīng)商設(shè)備封裝： | 32-TQFP（7x7） |
| 包裝： | 托盤 |
| 其它名稱： | 83940DYI-01LF |
ICS83940DYI-01 REVISION A SEPTEMBER 27, 2010
2
2010 Integrated Device Technology, Inc.
ICS83940I-01 Data Sheet
LOW SKEW, 1-TO-18 LVPECL-TO-LVCMOS/LVTTL FANOUT BUFFER
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refers to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1, 2, 12, 17, 25
GND
Power
Power supply ground.
3
LVCMOS_CLK
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
4
CLK_SEL
Input
Pulldown
Clock select input. When HIGH, selects LVCMOS_CLK input. When LOW,
selects PCLK, nPCLK inputs. LVCMOS / LVTTL interface levels.
5
PCLK
Input
Pulldown
Non-inverting differential LVPECL clock input.
6
nPCLK
Input
Pullup/
Pulldown
Inverting differential LVPECL clock input. VDD/2 default when left floating.
7VDD
Power
Power supply pin.
8, 16, 21, 29
VDDO
Power
Output supply pins.
9, 10, 11,
13, 14, 15,
18, 19, 20,
22, 23, 24,
26, 27, 28,
30, 31, 32
Q17, Q16, Q15,
Q14, Q13, Q12,
Q11, Q10, Q9,
Q8, Q7, Q6,
Q5, Q4, Q3,
Q2, Q1, Q0
Output
Single-ended clock outputs. LVCMOS/LVTTL interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4pF
RPULLDOWN
Input Pulldown Resistor
51
k
RPULLUP
Input Pullup Resistor
51
k
CPD
Power Dissipation Capacitance
(per output)
9pF
ROUT
Output Impedance
17
23
28
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