VCXO JITTER ATTENUATOR & FE" />
參數(shù)資料
型號(hào)： ICS813323BGLFT
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 5/22頁(yè)
文件大?。?/td> 0K
描述： IC ATTENUATOR/MULTIPLIER 24TSSOP
標(biāo)準(zhǔn)包裝： 2,500
系列： HiPerClockS™, FemtoClock™
類型： 扇出配送，頻率變換器，抖動(dòng)衰減器，壓控晶體振蕩器（VCXO）
PLL： 帶旁路
輸入： HCSL，LVDS，LVHSTL，LVPECL，SSTL
輸出： LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:3
差分 - 輸入:輸出： 是/是
頻率 - 最大： 622.08MHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 24-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 24-TSSOP
包裝： 帶卷 (TR)
其它名稱： 813323BGLFT
ICS813323BG REVISION A APRIL 13, 2010
13
2010 Integrated Device Technology, Inc.
ICS813323 Data Sheet
VCXO JITTER ATTENUATOR & FEMTOCLOCKMULTIPLIER
Differential Clock Input Interface
The CLK /nCLK accepts LVDS, LVPECL, LVHSTL, SSTL, HCSL and
other differential signals. Both VSWING and VOH must meet the VPP
and VCMR input requirements. Figures 3A to 3F show interface
examples for the CLK/nCLK input driven by the most common driver
types. The input interfaces suggested here are examples only.
Please consult with the vendor of the driver component to confirm the
driver termination requirements. For example, in Figure 3A, the input
termination applies for IDT open emitter LVHSTL drivers. If you are
using an LVHSTL driver from another vendor, use their termination
recommendation.
Figure 3A. CLK/nCLK Input Driven by an IDT Open
Emitter LVHSTL Driver
Figure 3C. CLK/nCLK Input Driven by a 3.3V LVPECL
Driver
Figure 3E. CLK/nCLK Input Driven by a 3.3V HCSL
Driver
Figure 3B. CLK/nCLK Input Driven by a 3.3V LVPECL
Driver
Figure 3D. CLK/nCLK Input Driven by a 3.3V LVDS Driver
Figure 3F. CLK/nCLK Input Driven by a 2.5V SSTL Driver
R1
50
R2
50
1.8V
Zo = 50
Zo = 50
CLK
nCLK
3.3V
LVHSTL
IDT
LVHSTL Driver
Differential
Input
R3
125
R4
125
R1
84
R2
84
3.3V
Zo = 50
Zo = 50
CLK
nCLK
3.3V
LVPECL
Differential
Input
HCSL
*R3
33
*R4
33
CLK
nCLK
3.3V
Zo = 50
Zo = 50
Differential
Input
R1
50
R2
50
*Optional – R3 and R4 can be 0
CLK
nCLK
Differential
Input
LVPECL
3.3V
Zo = 50
Zo = 50
3.3V
R1
50
R2
50
R2
50
3.3V
R1
100
LVDS
CLK
nCLK
3.3V
Receiver
Zo = 50
Zo = 50
CLK
nCLK
Differential
Input
SSTL
2.5V
Zo = 60
Zo = 60
2.5V
3.3V
R1
120
R2
120
R3
120
R4
120
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PDF描述
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