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參數(shù)資料
| 型號(hào)： | ICS670-01 |
| 英文描述： | Low Phase Noise Zero Delay Buffer and Multiplier |
| 中文描述： | 低相位噪聲零延遲緩沖器和乘法器 |
| 文件頁(yè)數(shù)： | 4/5頁(yè) |
| 文件大小： | 84K |
| 代理商： | ICS670-01 |
ICS670-01
Low Phase Noise Zero Delay Buffer and Multiplier
MDS 670-01 B
Integrated Circuit Systems 525 Race Street San Jose CA95126(408) 295-9800telhttp://www.icst.com
4
Revision 100900
Printed 11/15/00
-400
-300
-200
-100
0
100
200
300
0
25
50
75
100
125
150
CLK2 Frequency (MHz)
S
Figure 1.
ICS670-01 skew from ICLK to CLK2, with change in load capacitance.
VDD = 3.3 V.
The data in Figure 1 can be used to adjust individual circuit characteristics and achieve the minimum
possible skew between ICLK and CLK2. With a 125 MHz output, for example, having a total load
capacitance of 15 pF will result in nearly zero skew between ICLK and CLK2. Note that the load
capacitance includes board trace capacitance, input capacitance of the load being driven by the ICS670-01,
and any additional capacitors connected to CLK2.
Adjusting Input/Output Skew
CL = 20 pF
CL = 10 pF
Figure 2.
Phase Noise of ICS670-01 at 125 MHz out, 25 MHz clock input.
VDD = 3.3 V.
-140
10.0E+0
-120
-100
-80
-60
-40
-20
0
100.0E+0
1.0E+3
10.0E+3
100.0E+3
1.0E+6
10.0E+6
Offset from Carrier (Hz)
P
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