參數(shù)資料
型號(hào)： ICS1894K-32LFT
廠(chǎng)商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 35/50頁(yè)
文件大?。?/td> 0K
描述： PHYCEIVER LOW PWR 3.3V 32QFN
標(biāo)準(zhǔn)包裝： 1
系列： PHYceiver™
類(lèi)型： PHY 收發(fā)器
規(guī)程： MII，RMII
電源電壓： 3.14 V ~ 3.47 V
安裝類(lèi)型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝： 32-VFQFPN 裸露焊盤(pán)（4x4）
包裝： 標(biāo)準(zhǔn)包裝
其它名稱(chēng)： 800-2029-6
ICS1894-32
10BASE-T/100BASE-TX INTEGRATED PHYCEIVER WITH RMII INTERFACE
PHYCEIVER
IDT 10BASE-T/100BASE-TX INTEGRATED PHYCEIVER WITH RMII INTERFACE
40
ICS1894-32
REV M 021512
100M / MII Media Independent Interface: Transmit Latency
The table below lists the significant time periods for the MII/100 Stream Interface transmit latency. The time periods
consist of timings of signals on the following pins:
TXEN
TXCLK
TXD (that is, TXD[3:0])
TP_TX (that is, TP_TXP and TP_TXN)
The MII/100M Stream Interface Transmit Latency Timing Diagram shows the timing diagram for the time periods.
The IEEE maximum is 18 bit times.
MII/100M Stream Interface Transmit Latency Timing Diagram
Time
Period
Parameter
Conditions
Min. Typ.
Max.
Units
t1
TXEN Sampled to MDI Output of First
Bit of /J/
MII mode
–
2.8
3
Bit times
TXEN
TXCLK
TXD
TP_TX
Shown
unscrambled.
t1
Preamble /K/
Preamble /J/
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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ICS1894K-33LFT 制造商:Integrated Device Technology Inc 功能描述:PHYCEIVER LOW PWR 3.3V 32QFN
ICS1894K-34LF 制造商:Integrated Device Technology Inc 功能描述:PHYCEIVER LOW PWR 3.3V 32QFN
ICS1894K-34LFT 制造商:Integrated Device Technology Inc 功能描述:PHYCEIVER LOW PWR 3.3V 32QFN
ICS1894K-40LF 功能描述:PHYCEIVER LOW PWR 3.3V 40QFN RoHS:是 類(lèi)別:集成電路 (IC) >> 接口 - 驅(qū)動(dòng)器，接收器，收發(fā)器 系列:- 標(biāo)準(zhǔn)包裝:250 系列:- 類(lèi)型:收發(fā)器 驅(qū)動(dòng)器/接收器數(shù):2/2 規(guī)程:RS232 電源電壓:3 V ~ 5.5 V 安裝類(lèi)型:表面貼裝 封裝/外殼:16-TSSOP（0.173"，4.40mm 寬） 供應(yīng)商設(shè)備封裝:16-TSSOP 包裝:帶卷 (TR)
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