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參數(shù)資料
型號(hào): ICS1526GLF
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 11/11頁
文件大?。?/td> 0K
描述: IC VIDEO CLK SYNTHESIZER 16TSSOP
標(biāo)準(zhǔn)包裝: 96
類型: 時(shí)鐘/頻率合成器,頻率時(shí)序發(fā)生器
PLL: 帶旁路
輸入: LVTTL
輸出: LVCMOS
電路數(shù): 1
比率 - 輸入:輸出: 1:1
差分 - 輸入:輸出: 無/無
頻率 - 最大: 110MHz
除法器/乘法器: 是/無
電源電壓: 3 V ~ 3.6 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 16-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 16-TSSOP
包裝: 管件
其它名稱: 1526GLF
800-2352-5
ICS1526GLF-ND
MDS1526 P
9
Revision 051310
Integrated Device Technology, Inc. www.idt. com Tech Support: www.idt.com/go/clockhelp
(IDT/ICS)
Section 5 AC/DC Operating Conditions
ICS1526 Data Sheet
Table 5-4 AC Characteristics
Parameter
Symbol
Min.
Typical
Max.
Units
Notes
General
VCO Frequency
fVCO
40
400
MHz
Commercial temp. only
40
350
MHz
Industrial temp.
VCO Gain
K
165
MHz/V
AC Inputs
OSC Input Frequency
fOSC
0.02
100
MHz
Analog Input (HSYNC/VSYNC)
HSYNC Input Frequency
fHSYNC
8
10,000
kHz
VSYNC Input Frequency
fVSYNC
30
120
Hz
Input High Voltage
VIH
1.7
5.5
V
Input Low Voltage
VIL
VSS - 0.3
1.1
V
Input Hysteresis
0.2
0.8
V
Schmitt trigger active
SDA, SCL, OSC Digital Inputs
Input High Voltage
VIH
25.5
V
Input Low Voltage
VIL
VSS - 0.3
0.8
V
I2CADDR Digital Input
Input High Voltage
VIH
2
VDD+0.3
V
Input Low Voltage
VIL
VSS - 0.3
0.8
V
SDA Digital Output
SDA Output Low Voltage
VOL
0.4
V
IOUT = 3 mA
SDA Output High Voltage
VOH
6.0
V
Determined by
external Rset resistor
LVCMOS Outputs (CLK, HSYNC_out, VSYNC_out, LOCK)
Output Frequency
Fs
2.5
110
MHz
VDDD = 3.3 V
Duty Cycle
SDC
45
50
55
%
2
Jitter, STJ, RMS
STJ
0.027
ns
30 kHz input to 50
MHz output
Jitter, STJ, pk-pk
STJ
0.200
ns
Jitter, Input-Output
IOJ
2.500
ns
HSYNC in to CLK out
HSYNC to HSYNC_out
propagation delay (without
Schmitt trigger)
29
ns
1
HSYNC to HSYNC_out
propagation delay (with
Schmitt-trigger)
610
ns
1
CLK to HSYNC_out/
VSYNC_out skew
1.0
ns
Clock/ HSYNC_out/
VSYNC_out
Transition Time - Rise
TCR
1.0
1.5
ns
2
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