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參數(shù)資料
| 型號： | IA8044-PLC44I-01 |
| 廠商： | Innovasic Semiconductor |
| 英文描述： | SDLC COMMUNICATIONS CONTROLLER |
| 中文描述： | SDLC的通信控制器 |
| 文件頁數(shù)： | 23/49頁 |
| 文件大小： | 220K |
| 代理商： | IA8044-PLC44I-01 |
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IA8044/IA8344
Data Sheet
SDLC COMMUNICATIONS CONTROLLER
The state of bits RS1, RS0 selects the working registers bank as follows:
RS1/0
Bank selected location
00
Bank 0 (00H – 07H)
01
Bank 1 (08H – 0FH)
10
Bank 2 (10H – 17H)
11
Bank 3 (18H – 1FH)
Stack Pointer (SP):
The Stack Pointer is a 1-byte register initialized to 07H after reset. This register is incremented
before PUSH and CALL instructions, causing the stack to begin at location 08H. The stack pointer
points to a location in internal RAM.
SP
Bit: 7
6
5
4
SP.7
SP.6
SP.5
SP.4
Data Pointer (DPTR):
The Data Pointer (DPTR) is 2 bytes wide. The lower part is DPL, and the highest is DPH.
It can be loaded as 2 byte register (MOV DPTR,#data16) or as two registers (ea. MOV
DPL,#data8). It is generally used to access external code or data space (ea. MOVC
A,@A+DPTR or MOV A,@DPTR respectively).
DPH
Bit: 7
6
5
4
DPH.7
DPH.6
DPH.5
DPH.4
DPL
Bit: 7
6
5
4
DPL.7
DPL.6
DPL.5
DPL.4
Copyright
2003
innov
ASIC
The End of Obsolescence
ENG210010112-00
www.innovasic.com
Customer Support:
Page 23 of 49
1-888-824-4184
3
2
1
0
SP.3
SP.2
SP.1
SP.0
3
2
1
0
DPH.3
DPH.2
DPH.1
DPH.0
3
2
1
0
DPL.3
DPL.2
DPL.1
DPL.0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| IA8344 | SDLC COMMUNICATIONS CONTROLLER |
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| IA8344-PLC44I-01 | SDLC COMMUNICATIONS CONTROLLER |
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參數(shù)描述 |
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