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參數(shù)資料
| 型號(hào)： | HYB25D128160TT-3 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | 150 x 32 pixel format, LED Backlight available |
| 中文描述： | 記憶譜 |
| 文件頁(yè)數(shù)： | 33/85頁(yè) |
| 文件大?。?/td> | 3085K |
| 代理商： | HYB25D128160TT-3 |
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CL=2.5
Data Sheet
33
Rev. 1.0, 2004-04
HYB25D128[400/800/160]C[C/E/T](L)
128 Mbit Double Data Rate SDRAM
Functional Description
Figure 13
Random Read Accesses: CAS Latencies (Burst Length = 2, 4 or 8)
DOa-n
CAS Latency = 2
Read
Read
Read
NOP
NOP
Read
DOa-b
DOa-n’
DOa-x
DOa-x’
DOa-b’
DOa-g
CK
CK
Command
Address
DQS
DQ
DO a-n, etc. = data out from bank a, column n etc.
n' etc. = odd or even complement of n, etc. (i.e., column address LSB inverted).
Reads are to active rows in any banks.
Shown with nominal t
AC
, t
DQSCK
, and t
DQSQ
.
Don’t Care
BAa, COL n
BAa, COL x
BAa, COL b
BAa, COL g
CL=2
CAS Latency = 2.5
Read
Read
Read
NOP
NOP
Read
CK
CK
Command
Address
DQS
DQ
BAa, COL n
BAa, COL x
BAa, COL b
BAa, COL g
DOa-n
DOa-b
DOa-n’
DOa-x
DOa-x’
DOa-b’
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HYB25D128323CL-3.6 | 128 Mbit DDR SGRAM |
| HYB25D128323CL-4.5 | 128 Mbit DDR SGRAM |
| HYB25D128323CL3.6 | 128 Mbit DDR SGRAM |
| HYB25D128323C-3.3 | 128 Mbit DDR SGRAM |
| HYB25D128323C-3.6 | 128 Mbit DDR SGRAM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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