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參數(shù)資料
型號: HW-V5-ML506-UNI-G-J
廠商: Xilinx Inc
文件頁數(shù): 68/91頁
文件大小: 0K
描述: EVALUATION PLATFORM VIRTEX-5
標(biāo)準(zhǔn)包裝: 1
系列: Virtex®-5 SXT
類型: DSP
適用于相關(guān)產(chǎn)品: XC5VSX50TFFG1136
所含物品: 開發(fā)平臺,DVI 適配器和小型閃存卡
Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
70
TPSFD/ TPHFD
Full Delay (Legacy Delay or Default Delay)
Global Clock and IFF(2) without DCM or PLL
XC5VTX150T
N/A
2.35
–0.82
2.59
–0.82
ns
XC5VTX240T
N/A
2.59
–0.85
2.87
–0.85
ns
XC5VFX30T
2.05
–0.27
2.25
–0.27
2.57
–0.27
ns
XC5VFX70T
1.85
–0.30
2.06
–0.30
2.35
–0.30
ns
XC5VFX100T
2.20
–0.42
2.38
–0.42
2.66
–0.42
ns
XC5VFX130T
2.33
–0.55
2.59
–0.54
2.95
–0.54
ns
XC5VFX200T
N/A
2.52
–0.43
2.81
–0.43
ns
Notes:
1.
Setup and Hold times are measured over worst case conditions (process, voltage, temperature). Setup time is measured relative to the
Global Clock input signal using the slowest process, highest temperature, and lowest voltage. Hold time is measured relative to the Global
Clock input signal using the fastest process, lowest temperature, and highest voltage.
2.
IFF = Input Flip-Flop or Latch
3.
A Zero "0" Hold Time listing indicates no hold time or a negative hold time. Negative values can not be guaranteed "best-case", but if a "0"
is listed, there is no positive hold time.
Table 91: Global Clock Setup and Hold Without DCM or PLL (Cont’d)
Symbol
Description
Device
Speed Grade
Units
-3
-2
-1
相關(guān)PDF資料
PDF描述
RCB06DHLT CONN EDGECARD 12POS DIP .050 SLD
AP2151FMG-7 IC PWR SW USB 1CH 0.5A HI 6DFN
RBA18DTKH-S288 CONN EDGECARD 36POS .125 EXTEND
VE-J4Y-EZ CONVERTER MOD DC/DC 3.3V 16.5W
SDR-GY SCOTCH CODE REFILL GREY
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參數(shù)描述
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HW-V5-ML521-UNI-G 功能描述:EVALUATION PLATFORM VIRTEX-5 RoHS:是 類別:編程器,開發(fā)系統(tǒng) >> 過時/停產(chǎn)零件編號 系列:Virtex®-5 FXT/LXT 標(biāo)準(zhǔn)包裝:1 系列:- 傳感器類型:CMOS 成像,彩色(RGB) 傳感范圍:WVGA 接口:I²C 靈敏度:60 fps 電源電壓:5.7 V ~ 6.3 V 嵌入式:否 已供物品:成像器板 已用 IC / 零件:KAC-00401 相關(guān)產(chǎn)品:4H2099-ND - SENSOR IMAGE WVGA COLOR 48-PQFP4H2094-ND - SENSOR IMAGE WVGA MONO 48-PQFP