參數(shù)資料
型號: HW-V5-ML506-UNI-G-J
廠商: Xilinx Inc
文件頁數(shù): 65/91頁
文件大小: 0K
描述: EVALUATION PLATFORM VIRTEX-5
標(biāo)準(zhǔn)包裝: 1
系列: Virtex®-5 SXT
類型: DSP
適用于相關(guān)產(chǎn)品: XC5VSX50TFFG1136
所含物品: 開發(fā)平臺,DVI 適配器和小型閃存卡
Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
DS202 (v5.3) May 5, 2010
Product Specification
68
Table 90: Global Clock Input to Output Delay With DCM and PLL in Source-Synchronous Mode
Symbol
Description
Device
Speed Grade
Units
-3
-2
-1
LVCMOS25 Global Clock Input to Output Delay using Output Flip-Flop, 12mA, Fast Slew Rate, with DCM and PLL
in Source-Synchronous Mode
TICKOFDCM0_PLL
Global Clock and OUTFF with DCM and PLL
XC5VLX20T
N/A
3.66
4.11
ns
XC5VLX30
3.37
3.63
4.06
ns
XC5VLX30T
3.37
3.63
4.06
ns
XC5VLX50
3.39
3.65
4.08
ns
XC5VLX50T
3.39
3.65
4.08
ns
XC5VLX85
3.52
3.78
4.20
ns
XC5VLX85T
3.52
3.78
4.20
ns
XC5VLX110
3.57
3.84
4.27
ns
XC5VLX110T
3.57
3.84
4.27
ns
XC5VLX155
3.83
4.10
4.53
ns
XC5VLX155T
3.83
4.10
4.53
ns
XC5VLX220
N/A
4.33
4.76
ns
XC5VLX220T
N/A
4.33
4.76
ns
XC5VLX330
N/A
4.50
4.95
ns
XC5VLX330T
N/A
4.50
4.95
ns
XC5VSX35T
3.55
3.81
4.24
ns
XC5VSX50T
3.57
3.83
4.26
ns
XC5VSX95T
N/A
4.08
4.50
ns
XC5VSX240T
N/A
4.57
5.02
ns
XC5VTX150T
N/A
3.99
4.42
ns
XC5VTX240T
N/A
4.22
4.65
ns
XC5VFX30T
3.66
3.97
4.41
ns
XC5VFX70T
3.59
3.88
4.32
ns
XC5VFX100T
3.74
4.02
4.44
ns
XC5VFX130T
3.91
4.21
4.65
ns
XC5VFX200T
N/A
4.52
4.94
ns
Notes:
1.
Listed above are representative values where one global clock input drives one vertical clock line in each accessible column, and where all
accessible IOB and CLB flip-flops are clocked by the global clock net.
2.
DCM and PLL output jitter are already included in the timing calculation.
相關(guān)PDF資料
PDF描述
RCB06DHLT CONN EDGECARD 12POS DIP .050 SLD
AP2151FMG-7 IC PWR SW USB 1CH 0.5A HI 6DFN
RBA18DTKH-S288 CONN EDGECARD 36POS .125 EXTEND
VE-J4Y-EZ CONVERTER MOD DC/DC 3.3V 16.5W
SDR-GY SCOTCH CODE REFILL GREY
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