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參數(shù)資料
| 型號： | HT49R50 |
| 廠商： | Holtek Semiconductor Inc. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8-BIT MICROCONTROLLER |
| 中文描述： | 8位微控制器 |
| 文件頁數(shù)： | 50/59頁 |
| 文件大小： | 339K |
| 代理商： | HT49R50 |
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SZ [m].i
Skip if bit "i" of the data memory is zero
Description
If bit "i" of the specified data memory is zero, the following instruction,
fetched during the current instruction execution, is discarded and a dummy
cycle is replaced to get the proper instruction (two cycles). Otherwise proceed
with the next instruction (one cycle).
Operation
Skip if [m].i=0
Affected flag(s)
TC2
TC1
TO
PD
OV
Z
AC
C
TABRDC [m]
Move the ROM code (current page) to TBLH and data memory
Description
The low byte of ROM code (current page) addressed by the table pointer
(TBLP) is moved to the specified data memory and the high byte transferred
to TBLH directly.
Operation
[m]
TBLH
ROM code (low byte)
ROM code (high byte)
Affected flag(s)
TC2
TC1
TO
PD
OV
Z
AC
C
TABRDL [m]
Move the ROM code (last page) to TBLH and data memory
Description
The low byte of ROM code (last page) addressed by the table pointer (TBLP)
ismovedtothedatamemoryandthehighbytetransferredtoTBLHdirectly.
Operation
[m]
TBLH
ROM code (low byte)
ROM code (high byte)
Affected flag(s)
TC2
TC1
TO
PD
OV
Z
AC
C
XOR A,[m]
Logical XOR accumulator with data memory
Description
Data in the accumulator and the indicated data memory perform a bitwise
logical Exclusive_OR operation and the result is stored in the accumulator.
Operation
ACC
ACC "XOR" [m]
Affected flag(s)
TC2
TC1
TO
PD
OV
Z
AC
C
HT49R50
50
October 22, 1999
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HT5D048 | 0.8m CMOS High Speed Gate Array(0.8m CMOS高速門陣列) |
| HT5D028 | 0.8m CMOS High Speed Gate Array(0.8m CMOS高速門陣列) |
| HT5D064 | 0.8m CMOS High Speed Gate Array(0.8m CMOS高速門陣列) |
| HT5F240 | 0.8m CMOS High Speed Gate Array(0.8m CMOS高速門陣列) |
| HT5F256 | 0.8m CMOS High Speed Gate Array(0.8m CMOS高速門陣列) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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