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參數(shù)資料
| 型號： | HD64F2134FA20 |
| 英文描述： | 32-Bit Microcontroller |
| 中文描述： | 32位微控制器 |
| 文件頁數(shù)： | 445/891頁 |
| 文件大?。?/td> | 3213K |
| 代理商： | HD64F2134FA20 |
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iii
Section 5 Interrupt Controller.........................................................................99
5.1 Overview ......................................................................................................................... 99
5.1.1 Features .............................................................................................................. 99
5.1.2 Block Diagram.................................................................................................... 100
5.1.3 Pin Configuration................................................................................................ 101
5.1.4 Register Configuration........................................................................................ 101
5.2 Register Descriptions ....................................................................................................... 102
5.2.1 System Control Register (SYSCR)...................................................................... 102
5.2.2 Interrupt Control Registers A to C (ICRA to ICRC) ............................................ 103
5.2.3 IRQ Enable Register (IER) ................................................................................. 104
5.2.4 IRQ Sense Control Registers H and L (ISCRH, ISCRL)...................................... 105
5.2.5 IRQ Status Register (ISR) ................................................................................... 106
5.2.6 Keyboard Matrix Interrupt Mask Register (KMIMR) .......................................... 107
5.2.7 Address Break Control Register (ABRKCR)....................................................... 108
5.2.8 Break Address Registers A, B, C (BARA, BARB, BARC).................................. 109
5.3 Interrupt Sources.............................................................................................................. 110
5.3.1 External Interrupts .............................................................................................. 110
5.3.2 Internal Interrupts ............................................................................................... 112
5.3.3 Interrupt Exception Vector Table........................................................................ 112
5.4 Address Breaks ................................................................................................................ 115
5.4.1 Features .............................................................................................................. 115
5.4.2 Block Diagram.................................................................................................... 115
5.4.3 Operation............................................................................................................ 116
5.4.4 Usage Notes........................................................................................................ 116
5.5 Interrupt Operation........................................................................................................... 118
5.5.1 Interrupt Control Modes and Interrupt Operation ................................................ 118
5.5.2 Interrupt Control Mode 0 .................................................................................... 121
5.5.3 Interrupt Control Mode 1 .................................................................................... 123
5.5.4 Interrupt Exception Handling Sequence .............................................................. 126
5.5.5 Interrupt Response Times ................................................................................... 127
5.6 Usage Notes ..................................................................................................................... 128
5.6.1 Contention between Interrupt Generation and Disabling ..................................... 128
5.6.2 Instructions that Disable Interrupts...................................................................... 129
5.6.3 Interrupts during Execution of EEPMOV Instruction .......................................... 129
5.7 DTC Activation by Interrupt ............................................................................................ 130
5.7.1 Overview ............................................................................................................ 130
5.7.2 Block Diagram.................................................................................................... 130
5.7.3 Operation............................................................................................................ 131
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