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參數資料
| 型號： | HD6435368SF |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | Single-Chip Microcomputer |
| 中文描述： | 單片機 |
| 文件頁數： | 289/487頁 |
| 文件大?。?/td> | 1408K |
| 代理商： | HD6435368SF |
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When a framing or parity error occurs, the RSR contents are transferred to the RDR. If an
overrun error occurs, however, the RSR contents are not transferred to the RDR.
If multiple receive errors occur simultaneously, all the corresponding error flags are set to 1.
To clear a receive-error flag (ORER, FER, or PER), software must read the SSR, then write a 0
in the flag bit.
Table 14-8 Receive Errors
Name
Overrun error
Abbreviation
ORER
Description
Reception of the next frame ends while the RDRF bit is still
set to 1.
The RSR contents are not transferred to the RDR.
A stop bit is 0.
The RSR contents are transferred to the RDR.
The parity of a frame does not match the value selected by the bit
in the SMR.
The RSR contents are transferred to the RDR.
Framing error
FER
Parity error
PER
14.3.3 Synchronous Mode
The synchronous mode is suited for high-speed, continuous data transfer. Each bit of data is
synchronized with a serial clock pulse.
Continuous data transfer is enabled by the double buffering employed in both the transmit and
receive sections of the SCI. Full duplex communication is possible because the transmit and
receive sections are independent.
1. Data Format:
Figure 14-4 shows the communication format used in the synchronous mode.
The data length is 8 bits for both the transmit and receive directions. The least significant bit
(LSB) is sent and received first. Each bit of transmit data is output from the falling edge of the
serial clock pulse to the next falling edge. Received bits are latched on the rising edge of the
serial clock pulse.
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相關PDF資料 |
PDF描述 |
|---|---|
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參數描述 |
|---|---|
| HD6437020SX20 | 制造商:Renesas Electronics Corporation 功能描述: |
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| HD6437021SX20 | 制造商:Renesas Electronics Corporation 功能描述: |
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