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參數(shù)資料
| 型號： | HD6435348RCP |
| 廠商： | Hitachi,Ltd. |
| 英文描述： | Single-Chip Microcomputer |
| 中文描述： | 單片機 |
| 文件頁數(shù)： | 253/487頁 |
| 文件大?。?/td> | 1408K |
| 代理商： | HD6435348RCP |
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Table 12-3 PWM Timer Parameters for 10 MHz System Clock
Internal Clock Frequency
Resolution
PWM Period
PWM Frequency
/2
200 ns
50 μs
20 kHz
/8
800 ns
200 μs
5 kHz
/32
3.2 μs
800 μs
1.25 kHz
/128
12.8 μs
3.2 ms
312.5 Hz
/256
25.6 μs
6.4 ms
156.3 Hz
/1024
102.4 μs
25.6 ms
39.1 Hz
/2048
204.8 μs
51.2 ms
19.5 Hz
/4096
409.6 μs
102.4 ms
9.8 Hz
12.3 Operation
Figure 12-2 shows the timing of the PWM timer operation.
1. Positive Logic (OS = 0)
(1) When OE = 0—(a) in Figure 12-2:
The timer count is held at H'00 and PWM output is
inhibited. (The pin is used for port 9 input/output, and its state depends on the corresponding
port 9 data register and data direction register.) Any value (such as N in figure 12-2) written
in the DTR becomes valid immediately.
(2) When OE = 1
i) The timer counter begins incrementing, and the PWM output goes High. [(b) in figure 12-2]
ii) When the count reaches the DTR value, the PWM output goes Low. [(c) in figure 12-2]
iii)If the DTR value is changed (by writing the data M in figure 12-2), the new value
becomes valid after the timer count changes from H'F9 to H'00. [(d) in figure 12-2]
2. Negative Logic (OS = 1):
The operation is the same except that High and Low are reversed in
the PWM output. [(e) in figure 12-2]
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