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參數(shù)資料
| 型號： | HD6433690G |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | 16-Bit Single-Chip Microcomputer H8 Family/H8/300H Tiny Series |
| 中文描述： | 16位單片機H8 Family/H8/300H Tiny系列 |
| 文件頁數(shù)： | 9/432頁 |
| 文件大?。?/td> | 2457K |
| 代理商： | HD6433690G |
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Rev. 4.00, 03/04, page ix of xxviii
Contents
Section 1 Overview............................................................................................1
1.1
Features.............................................................................................................................1
1.2
Internal Block Diagram.....................................................................................................3
1.3
Pin Arrangement...............................................................................................................5
1.4
Pin Functions ....................................................................................................................8
Section 2 CPU....................................................................................................11
2.1
Address Space and Memory Map.....................................................................................12
2.2
Register Configuration......................................................................................................15
2.2.1
General Registers.................................................................................................16
2.2.2
Program Counter (PC).........................................................................................17
2.2.3
Condition-Code Register (CCR)..........................................................................17
2.3
Data Formats.....................................................................................................................19
2.3.1
General Register Data Formats............................................................................19
2.3.2
Memory Data Formats.........................................................................................21
2.4
Instruction Set...................................................................................................................22
2.4.1
Table of Instructions Classified by Function.......................................................22
2.4.2
Basic Instruction Formats....................................................................................31
2.5
Addressing Modes and Effective Address Calculation.....................................................32
2.5.1
Addressing Modes ...............................................................................................32
2.5.2
Effective Address Calculation .............................................................................36
2.6
Basic Bus Cycle................................................................................................................38
2.6.1
Access to On-Chip Memory (RAM, ROM).........................................................38
2.6.2
On-Chip Peripheral Modules...............................................................................39
2.7
CPU States........................................................................................................................40
2.8
Usage Notes......................................................................................................................41
2.8.1
Notes on Data Access to Empty Areas ................................................................41
2.8.2
EEPMOV Instruction...........................................................................................41
2.8.3
Bit Manipulation Instruction................................................................................41
Section 3 Exception Handling ...........................................................................47
3.1
Exception Sources and Vector Address............................................................................47
3.2
Register Descriptions........................................................................................................49
3.2.1
Interrupt Edge Select Register 1 (IEGR1) ...........................................................49
3.2.2
Interrupt Edge Select Register 2 (IEGR2) ...........................................................50
3.2.3
Interrupt Enable Register 1 (IENR1)...................................................................51
3.2.4
Interrupt Flag Register 1 (IRR1)..........................................................................52
3.2.5
Wakeup Interrupt Flag Register(IWPR)..............................................................53
3.3
Reset Exception Handling.................................................................................................54
相關(guān)PDF資料 |
PDF描述 |
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