參數(shù)資料
型號: GS84118B-166
英文描述: x18 Synchronous SRAM
中文描述: x18同步SRAM
文件頁數(shù): 25/30頁
文件大?。?/td> 584K
代理商: GS84118B-166
Rev: 1.05 7/2001
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1999, Giga Semiconductor, Inc.
GS84118T/B-166/150/130/100
Boundary Scan Register (54 Bits)
The Boundary Scan Register are 54 bits wide and are listed as follow:
Scan Order (Order by exit sequence)
DQx, Match
19
Address
18
GW, BWE, BW1-2, DE
5
CE1, CE2, CE3
3
OE, MOE
2
ADSP, ADSC, ADV
3
ZZ, FT, LBO
3
CLK
1
Total
54
Order
Signal
TQFP
BGA
Order
Signal
TQFP
BGA
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
A15
A14
A13
A12
A11
A16
A17
MOE
DE
MATCH
DQ1
DQ2
DQ3
DQ4
ZZ
DQ5
DQ6
DQ7
DQ8
DQP1
A10
A9
A8
ADV
ADSP
ADSC
OE
44
45
46
47
48
49
50
51
52
53
58
59
62
63
64
68
69
72
73
74
80
81
82
83
84
85
86
3T
2T
5T
6R
5C
5B
6C
6P
7N
6M
7P
6N
6L
7K
7T
6H
7G
6F
7E
6D
6T
6A
5A
4G
4A
4B
4F
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
BWE
GW
CLK
CE3
BW1
BW2
CE2
CE1
A7
A6
DQ9
DQ10
DQ11
DQ12
FT
DQ13
DQ14
DQ15
DQ16
DQP2
LBO
A5
A4
A3
A2
A1
A0
87
88
89
92
93
94
97
98
99
100
8
9
12
13
14
18
19
22
23
24
31
32
33
34
35
36
37
4M
4H
4K
6B
5L
3G
2B
4E
3A
2A
1D
2E
2G
1H
5R
2K
1L
2M
1N
2P
3R
2C
3B
3C
2R
4N
4P
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