參數(shù)資料
型號(hào)： fp_add_sub
廠商： Altera Corporation
英文描述： Floating-Point Adder/Subtractor(浮點(diǎn)型加法器/減法器)
中文描述： 浮點(diǎn)加法器/減法（浮點(diǎn)型加法器/減法器）
文件頁(yè)數(shù)： 1/8頁(yè)
文件大?。?/td> 132K
代理商： FP_ADD_SUB
Altera Corporation
1
fp_add_sub
Floating-Point Adder/Subtractor
January 1996, ver. 1
Functional Specification 2
A-FS-02-01
Features
I
fp_add_sub
adder/subtractor
Parameterized mantissa and exponent widths
Optimized for FLEX 10K and FLEX 8000 device families
High-speed operation
Supported by schematic and text design entry methods, including
VHDL, Verilog HDL, and the Altera Hardware Description
Language (AHDL)
reference design implementing a floating-point
I
I
I
I
General
Description
The
adder/subtractor with parameterized input widths. This function uses
sign-mantissa-exponent notation with parameterized mantissa and
exponent widths. See
Figure 1
.
fp_add_sub
reference design implements a floating-point
Figure 1. fp_add_sub Symbol
Function Prototype
The AHDL Function Prototype for the
below:
fp_add_sub
function is shown
FUNCTION fp_add_sub (sa, ma[mantissa_width..1], ea[exponent_width..1],
sb, mb[mantissa_width..1], eb[exponent_width..1], add_sub)
WITH (mantissa_width, exponent_width)
RETURNS (m_out[mantissa_width..1], e_out[exponent_width..1],
s_out);
SA
MA[MANTISSA_WIDTH..1]
EA[EXPONENT_WIDTH..1]
SB
MB[MANTISSA_WIDTH..1]
EB[EXPONENT_WIDTH..1]
ADD_SUB
M_OUT[MANTISSA_WIDTH..1]
E_OUT[EXPONENT_WIDTH..1]
S_OUT
FP_ADD_SUB
EXPONENT_WIDTH=
MANTISSA_WIDTH=
相關(guān)PDF資料
PDF描述
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FP1602 CURRENT 16.0 Amperes VOLTAGE 50 to 1000 Volts
FP1603 CURRENT 16.0 Amperes VOLTAGE 50 to 1000 Volts
FP1604 CURRENT 16.0 Amperes VOLTAGE 50 to 1000 Volts
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參數(shù)描述
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FPAL15SL60 功能描述:IGBT 晶體管 600V/15A/SPM RoHS:否 制造商:Fairchild Semiconductor 配置: 集電極—發(fā)射極最大電壓 VCEO:650 V 集電極—射極飽和電壓:2.3 V 柵極/發(fā)射極最大電壓:20 V 在25 C的連續(xù)集電極電流:150 A 柵極—射極漏泄電流:400 nA 功率耗散:187 W 最大工作溫度: 封裝 / 箱體:TO-247 封裝:Tube
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