參數資料
型號： EPM7064AETC100-10N
廠商： Altera
文件頁數： 26/64頁
文件大小： 0K
描述： IC MAX 7000 CPLD 64 100-TQFP
產品變化通告： Bond Wire Change 4/Sept/2008
標準包裝： 270
系列： MAX® 7000A
可編程類型： 系統(tǒng)內可編程
最大延遲時間 tpd(1)： 10.0ns
電壓電源 - 內部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數目： 4
宏單元數： 64
門數： 1250
輸入/輸出數： 68
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 100-TQFP
供應商設備封裝： 100-TQFP（14x14）
包裝： 托盤
產品目錄頁面： 604 (CN2011-ZH PDF)
其它名稱： 544-2007
EPM7064AETC100-10N-ND
32
Altera Corporation
MAX 7000A Programmable Logic Device Data Sheet
Figure 11. MAX 7000A Timing Model
The timing characteristics of any signal path can be derived from the
timing model and parameters of a particular device. External timing
parameters, which represent pin-to-pin timing delays, can be calculated
as the sum of internal parameters. Figure 12 shows the timing relationship
between internal and external delay parameters.
f See Application Note 94 (Understanding MAX 7000 Timing) for more
information.
Logic Array
Delay
t LAD
Output
Delay
t OD3
t OD2
t OD1
t XZ
Z
t X1
t ZX2
t ZX3
Input
Delay
t IN
Register
Delay
t SU
t H
t PRE
t CLR
t RD
t COMB
t FSU
t FH
PIA
Delay
t PIA
Shared
Expander Delay
t SEXP
Register
Control Delay
t LAC
t IC
t EN
I/O
Delay
t IO
Global Control
Delay
t GLOB
Internal Output
Enable Delay
t IOE
Parallel
Expander Delay
t PEXP
Fast
Input Delay
t FIN
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PDF描述
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參數描述
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