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參數(shù)資料
| 型號： | EPM7032S |
| 廠商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family |
| 中文描述： | 可編程邏輯器件系列 |
| 文件頁數(shù)： | 20/60頁 |
| 文件大小： | 943K |
| 代理商： | EPM7032S |
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20
Altera Corporation
MAX 7000A Programmable Logic Device Data Sheet
Figure 8
shows timing information for the JTAG signals.
Figure 8. MAX 7000A JTAG Waveforms
Table 8
shows the JTAG timing parameters and values for MAX 7000A
devices.
Note:
(1)
Timing parameters shown in this table apply for all specified VCCIO levels.
Table 8. JTAG Timing Parameters & Values for MAX 7000A Devices
Note (1)
Symbol
Parameter
Min
Max
Unit
t
JCP
t
JCH
t
JCL
t
JPSU
t
JPH
t
JPCO
t
JPZX
t
JPXZ
t
JSSU
t
JSH
t
JSCO
t
JSZX
t
JSXZ
TCK
clock period
TCK
clock high time
TCK
clock low time
JTAG port setup time
JTAG port hold time
JTAG port clock to output
JTAG port high impedance to valid output
JTAG port valid output to high impedance
Capture register setup time
Capture register hold time
Update register clock to output
Update register high impedance to valid output
Update register valid output to high impedance
100
50
50
20
45
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
25
25
25
20
45
25
25
25
TDO
TCK
t
JPZX
t
JPCO
t
JPH
t
JPXZ
t
JCP
t
JPSU
t
JCL
t
JCH
TDI
TMS
Signal
to Be
Captured
Signal
to Be
Driven
t
JSZX
t
JSSU
t
JSH
t
JSCO
t
JSXZ
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EPM7064 | Programmable Logic Device Family |
| EPM7064S | Programmable Logic Device Family |
| EPM7512AEBC256-12 | Programmable Logic Device |
| EPM7032LC44-12 | Programmable Logic Device Family |
| EPM7128AETC144-7 | Programmable Logic Device |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| EPM7032SLC44-10N | 制造商:Altera Corporation 功能描述:IC MAX ISP PLD 7032 PLCC44 3.3V |
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