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參數(shù)資料
| 型號： | EPM3256AQI208-6 |
| 廠商： | ALTERA CORP |
| 元件分類： | PLD |
| 英文描述： | EE PLD, 6 ns, PQFP208 |
| 封裝： | PLASTIC, QFP-208 |
| 文件頁數(shù)： | 18/43頁 |
| 文件大?。?/td> | 716K |
| 代理商： | EPM3256AQI208-6 |
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Altera Corporation
25
MAX 3000A Programmable Logic Device Family Data Sheet
Preliminary Information
Table 15. MAX 3000A External Timing Parameters
Symbol
Parameter
Conditions
Speed Grade
Unit
-7
-10
Min
Max
Min
Max
tPD1
Input to non-registered output
C1 = 35 pF
7.5
10.0
ns
tPD2
I/O input to non-registered output
C1 = 35 pF
7.5
10.0
ns
tSU
Global clock setup time
4.9
6.6
ns
tH
Global clock hold time
0.0
ns
tCO1
Global clock to output delay
C1 = 35 pF
1.0
4.5
1.0
5.9
ns
tCH
Global clock high time
3.0
4.0
ns
tCL
Global clock low time
3.0
4.0
ns
tASU
Array clock setup time
1.6
2.1
ns
tAH
Array clock hold time
2.1
3.4
ns
tACO1
Array clock to output delay
C1 = 35 pF
7.8
10.4
ns
tACH
Array clock high time
3.0
4.0
ns
tACL
Array clock low time
3.0
4.0
ns
tCPPW
Minimum pulse width for clear and
preset
2.0
3.0
tCNT
Minimum global clock period
8.4
11.2
ns
fCNT
Maximum internal global clock
frequency
119.0
89.3
MHz
tACNT
Minimum array clock period
8.4
11.2
ns
fACNT
Maximum internal array clock
frequency
119.0
89.3
MHz
fMAX
Maximum clock frequency
166.7
125.0
MHz
相關PDF資料 |
PDF描述 |
|---|---|
| EPM7128ABC100-6 | EE PLD, 6 ns, PBGA100 |
| EPM7128ABC100-7 | EE PLD, 7.5 ns, PBGA100 |
| EPM7128ABI100-10 | EE PLD, 10 ns, PBGA100 |
| EPM7128ABI100-12 | EE PLD, 12 ns, PBGA100 |
| EPM7128ABI100-6 | EE PLD, 6 ns, PBGA100 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| EPM3256ATC14410N | 制造商:ALTERA 功能描述:NEW |
| EPM3256ATC144-10N | 功能描述:CPLD - 復雜可編程邏輯器件 CPLD - MAX 3000A 256 Macro 116 IOs RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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