參數(shù)資料
型號： EP4SGX290NF45C4
廠商： Altera
文件頁數(shù)： 69/82頁
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描述： IC STRATIX IV FPGA 290K 1932FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 3
系列： Stratix® IV GX
LAB/CLB數(shù)： 11648
邏輯元件/單元數(shù)： 291200
RAM 位總計： 17661952
輸入/輸出數(shù)： 920
電源電壓： 0.87 V ~ 0.93 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 1932-BBGA
供應(yīng)商設(shè)備封裝： 1932-FBGA（45x45）
Chapter 1: DC and Switching Characteristics for Stratix IV Devices
1–63
I/O Timing
March 2014
Altera Corporation
Stratix IV Device Handbook
Volume 4: Device Datasheet and Addendum
Programmable IOE Delay
Table 1–52 lists the Stratix IV IOE programmable delay settings.
Programmable Output Buffer Delay
Table 1–53 lists the delay chain settings that control the rising and falling edge delays
of the output buffer. The default delay is 0 ps.
Table 1–52. IOE Programmable Delay for Stratix IV Devices
Parameter
Available
Settings
Min Offset
Fast Model
Slow Model
Industrial/
Military
Commercial
C2 (3)
C3
C4
I3/M3
I4
Unit
D1
16
0
0.462
0.505
0.732
0.795
0.857
0.801
0.864
ns
D2
8
0
0.234
0.232
0.337
0.372
0.407
0.371
0.405
ns
D3
8
0
1.700
1.769
2.695
2.927
3.157
2.948
3.178
ns
D4
16
0
0.508
0.554
0.813
0.882
0.952
0.889
0.959
ns
D5
16
0
0.472
0.500
0.747
0.799
0.875
0.817
0.882
ns
D6
7
0
0.186
0.195
0.294
0.319
0.345
0.321
0.347
ns
Notes to Table 1–52:
(1) You can set this value in the Quartus II software by selecting D1, D2, D3, D4, D5, and D6 in the Assignment Name column.
(2) Minimum offset does not include the intrinsic delay.
(3) For the EP4SGX530 device density, the IOE programmable delays have an additional 5% maximum offset.
Table 1–53. Programmable Output Buffer Delay (1)
Symbol
Parameter
Typical
Unit
DOUTBUF
Rising and/or falling edge
delay
0 (default)
ps
50
ps
100
ps
150
ps
Note to Table 1–53:
(1) You can set the programmable output buffer delay in the Quartus II software by setting the Output Buffer Delay
Control assignment to either positive, negative, or both edges, with the specific values stated here (in ps) for the
Output Buffer Delay assignment.
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PDF描述
EP4SGX530HH35C4 IC STRATIX IV FPGA 530K 1152HBGA
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AGM40DRMD-S288 CONN EDGECARD EXTEND 80POS .156
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EP4SGX290NF45I3N 功能描述:FPGA - 現(xiàn)場可編程門陣列 FPGA - Stratix IV GX 11648 LABs 920 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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