參數(shù)資料
型號(hào)： EP4SGX180DF29I3
廠商： Altera
文件頁(yè)數(shù)： 30/82頁(yè)
文件大?。?/td> 0K
描述： IC STRATIX IV FPGA 180K 780FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 3
系列： Stratix® IV GX
LAB/CLB數(shù)： 7030
邏輯元件/單元數(shù)： 175750
RAM 位總計(jì)： 13954048
輸入/輸出數(shù)： 372
電源電壓： 0.87 V ~ 0.93 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 780-BBGA
供應(yīng)商設(shè)備封裝： 780-FBGA（29x29）
Chapter 1: DC and Switching Characteristics for Stratix IV Devices
1–28
Switching Characteristics
March 2014
Altera Corporation
Stratix IV Device Handbook
Volume 4: Device Datasheet and Addendum
Differential on-chip
termination
resistors
85
setting
85 ± 20%
100
setting
100 ± 20%
120
setting
120 ± 20%
150-
setting
150 ± 20%
Differential and
common mode
return loss
PCIe (Gen 1
and Gen 2),
XAUI,
HiGig+,
CEI SR/LR,
Serial RapidIO
SR/LR,
CPRI LV/HV,
OBSAI,
SATA
Compliant
—
Programmable PPM
detector (7)
——
± 62.5, 100, 125, 200,
250, 300, 500, 1000
ppm
Run length
—
200
—
200
—
200
UI
Programmable
equalization
——
—
16
—
16
—
16
dB
tLTR (8)
——
—
75
—
75
—
75
s
tLTR_LTD_Manual (9)
—15
—
15
—
15
—
s
tLTD_Manual (10)
—
4000
—
4000
—
4000
ns
tLTD_Auto (11)
—
4000
—
4000
—
4000
—
ns
Receiver buffer and
CDR offset
cancellation time
(per channel)
—
17000
—
17000
—
17000
reconfig_clk
cycles
Programmable DC
gain
DC Gain Setting
= 0
—0
—
0
—
0
—
dB
DC Gain Setting
= 1
—3
—
3
—
3
—
dB
DC Gain Setting
= 2
—6
—
6
—
6
—
dB
DC Gain Setting
= 3
—9
—
9
—
9
—
dB
DC Gain Setting
= 4
—12
—
12
—
12
—
dB
EyeQ Max Data Rate
—
4.0
—
4.0
—
4.0
Gbps
Table 1–24. Transceiver Specifications for Stratix IV GT Devices (Part 4 of 8)
Symbol/
Description
Conditions
–1 Industrial Speed
Grade
–2 Industrial Speed
Grade
–3 Industrial Speed
Grade
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
相關(guān)PDF資料
PDF描述
EP4SGX180DF29C2X IC STRATIX IV FPGA 180K 780FBGA
EP4SGX180HF35I3N IC STRATIX IV FPGA 180K 1152FBGA
EP4SGX180HF35C2N IC STRATIX IV FPGA 180K 1152FBGA
EP4SGX230FF35I4N IC STRATIX IV FPGA 230K 1152FBGA
EP4SE230F29I4 IC STRATIX IV FPGA 230K 780FBGA
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