參數(shù)資料
型號(hào)： EP2SGX30CF780C3N
廠商： Altera
文件頁數(shù)： 492/1486頁
文件大小： 0K
描述： IC STRATIX II GX 30K 780-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 9
系列： Stratix® II GX
LAB/CLB數(shù)： 1694
邏輯元件/單元數(shù)： 33880
RAM 位總計(jì)： 1369728
輸入/輸出數(shù)： 361
電源電壓： 1.15 V ~ 1.25 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 780-BBGA
供應(yīng)商設(shè)備封裝： 780-FBGA（29x29）
其它名稱： 544-1926
EP2SGX30CF780C3N-ND
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14–30
Altera Corporation
Stratix II GX Device Handbook, Volume 2
October 2007
System Design Guidelines
The MAX II device or microprocessor and flash configuration can use
FPP, PS, or PPA. Decompression and design security features are
supported in the FPP (requires 4× DCLK) and PS modes only. Figure 14–9
shows a system block diagram for remote system upgrade with the
MAX II device or microprocessor and flash.
Figure 14–9. System Block Diagram for Remote System Upgrade With MAX II
Device or Microprocessor and Flash Device
(1)
Connect the pull-up resistor to a supply that provides an acceptable input signal
for the device.
(2)
Connect RUnLU to GND or VCC to select between remote and local update modes.
(3)
Connect MSEL[3..0] to 0100 to enable remote update remote system upgrade
mode.
Remote System Upgrade with Enhanced Configuration Devices
■
Enhanced Configuration devices support remote system upgrade
with FPP or PS configuration schemes. The Stratix II or Stratix II GX
decompression and design security features are only supported in
the PS mode. The enhanced configuration device’s decompression
feature is supported in both PS and FPP schemes.
■
In remote update mode, neither the factory configuration nor the
application configurations should alter the enhanced configuration
device’s option bits or the page 000 factory configuration data. This
ensures that an error during remote update can always be resolved
by reverting to the factory configuration located at page 000.
External Host
(MAX II Device or
Microprocessor)
CONF_DONE
nSTATUS
nCE
DATA[7..0]
nCONFIG
Stratix II/Stratix II GX Device
Memory
ADDR DATA[7..0]
GND
MSEL[3..0]
VCC (1)
DCLK
nCEO
N.C.
10 k
Ω
10 k
Ω
PGM[2..0]
RUnLU
(2)
(3)
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PDF描述
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