參數(shù)資料
型號(hào)： EP2SGX30CF780C3
廠商： Altera
文件頁(yè)數(shù)： 436/1486頁(yè)
文件大?。?/td> 0K
描述： IC STRATIX II GX 30K 780-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 9
系列： Stratix® II GX
LAB/CLB數(shù)： 1694
邏輯元件/單元數(shù)： 33880
RAM 位總計(jì)： 1369728
輸入/輸出數(shù)： 361
電源電壓： 1.15 V ~ 1.25 V
安裝類(lèi)型： 表面貼裝
工作溫度： 0°C ~ 70°C
封裝/外殼： 780-BBGA
供應(yīng)商設(shè)備封裝： 780-FBGA（29x29）
其它名稱(chēng)： 544-1747
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13–88
Altera Corporation
Stratix II GX Device Handbook, Volume 2
October 2007
JTAG Configuration
Table 13–20. Dedicated Configuration Pin Connections During JTAG
Configuration
Signal
Description
nCE
On all Stratix II or Stratix II GX devices in the chain, nCE should
be driven low by connecting it to ground, pulling it low via a
resistor, or driving it by some control circuitry. For devices that
are also in multi-device FPP, AS, PS, or PPA configuration
chains, the nCE pins should be connected to GND during JTAG
configuration or JTAG configured in the same order as the
configuration chain.
nCEO
On all Stratix II or Stratix II GX devices in the chain, nCEO can be
left floating or connected to the nCE of the next device.
MSEL
These pins must not be left floating. These pins support
whichever non-JTAG configuration is used in production. If only
JTAG configuration is used, tie these pins to ground.
nCONFIG
Driven high by connecting to VCC, pulling up via a resistor, or
driven high by some control circuitry.
nSTATUS
Pull to VCC via a 10-k
Ω resistor. When configuring multiple
devices in the same JTAG chain, each nSTATUS pin should be
pulled up to VCC individually.
CONF_DONE Pull to VCC via a 10-k
Ω resistor. When configuring multiple
devices in the same JTAG chain, each CONF_DONE pin should
be pulled up to VCC individually. CONF_DONE going high at the
end of JTAG configuration indicates successful configuration.
DCLK
Should not be left floating. Drive low or high, whichever is more
convenient on your board.
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