參數(shù)資料
型號: EP2AGX65CU17C6N
廠商: Altera
文件頁數(shù): 82/90頁
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描述: IC ARRIA II GX FPGA 65K 358UBGA
產(chǎn)品培訓模塊: Three Reasons to Use FPGA's in Industrial Designs
標準包裝: 6
系列: Arria II GX
LAB/CLB數(shù): 2530
邏輯元件/單元數(shù): 60214
RAM 位總計: 5371904
輸入/輸出數(shù): 156
電源電壓: 0.87 V ~ 0.93 V
安裝類型: 表面貼裝
工作溫度: 0°C ~ 85°C
封裝/外殼: 358-UBGA
供應商設備封裝: 358-UBGA
Chapter 1: Device Datasheet for Arria II Devices
1–75
Glossary
December 2013
Altera Corporation
G,
H,
I,
J
J
High-speed I/O block: Deserialization factor (width of parallel data bus).
JTAG Timing
Specifications
JTAG Timing Specifications:
K,
L,
M,
N,
O,
P
PLL
Specifications
PLL Specification parameters:
Diagram of PLL Specifications (1)
Notes:
(1) CoreClock can only be fed by dedicated clock input pins or PLL outputs.
(2) This is the VCO post-scale counter K.
Q,
R
RL
Receiver differential input discrete resistor (external to the Arria II device).
Table 1–68. Glossary (Part 2 of 4)
Letter
Subject
Definitions
TDO
TCK
tJPZX
t
JPCO
tJPH
t JPXZ
tJCP
tJPSU
t JCL
tJCH
TDI
TMS
Core Clock
External Feedback
Reconfigurable in User Mode
Key
CLK
N
M
/K
PFD
Switchover
VCO
CP
LF
CLKOUT Pins
GCLK
RCLK
fINPFD
fIN
fVCO
fOUT
fOUT_EXT
K
(2)
Counters
C0..C9
相關PDF資料
PDF描述
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