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參數(shù)資料
| 型號(hào)： | EP2AGX65CU17C6N |
| 廠商： | Altera |
| 文件頁(yè)數(shù)： | 47/90頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC ARRIA II GX FPGA 65K 358UBGA |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 6 |
| 系列： | Arria II GX |
| LAB/CLB數(shù)： | 2530 |
| 邏輯元件/單元數(shù)： | 60214 |
| RAM 位總計(jì)： | 5371904 |
| 輸入/輸出數(shù)： | 156 |
| 電源電壓： | 0.87 V ~ 0.93 V |
| 安裝類(lèi)型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 358-UBGA |
| 供應(yīng)商設(shè)備封裝： | 358-UBGA |
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Chapter 1: Device Datasheet for Arria II Devices
1–43
Switching Characteristics
December 2013
Altera Corporation
SSC modulation
deviation at
1.5 Gbps (G1)
Compliance
pattern
5700
ppm
RX differential
skew at 1.5 Gbps
(G1)
Compliance
pattern
80
ps
RX AC common
mode voltage at
1.5 Gbps (G1)
Compliance
pattern
150
mV
Total jitter
tolerance at
3.0 Gbps (G2)
Compliance
pattern
> 0.65
UI
Deterministic
jitter tolerance at
3.0 Gbps (G2)
Compliance
pattern
> 0.35
UI
SSC modulation
frequency at
3.0 Gbps (G2)
Compliance
pattern
33
kHz
SSC modulation
deviation at
3.0 Gbps (G2)
Compliance
pattern
5700
ppm
RX differential
skew at 3.0 Gbps
(G2)
Compliance
pattern
75
ps
RX AC common
mode voltage at
3.0 Gbps (G2)
Compliance
pattern
150
mV
Total jitter
tolerance at
6.0 Gbps (G3)
Compliance
pattern
> 0.60
UI
Random jitter
tolerance at
6.0 Gbps (G3)
Compliance
pattern
> 0.18
UI
SSC modulation
frequency at
6.0 Gbps (G3)
Compliance
pattern
33
kHz
SSC modulation
deviation at
6.0 Gbps (G3)
Compliance
pattern
5700
ppm
RX differential
skew at 6.0 Gbps
(G3)
Compliance
pattern
30
ps
RX AC common
mode voltage at
6.0 Gbps (G3)
Compliance
pattern
100
mV
Table 1–40. Transceiver Block Jitter Specifications for Arria II GX Devices (Note 1) (Part 7 of 10)
Symbol/
Description
Conditions
I3
C4
C5, I5
C6
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| IDT7005S35PFG | IC SRAM 64KBIT 35NS 64TQFP |
| IDT7024S25PF | IC SRAM 64KBIT 25NS 100TQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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