參數(shù)資料
型號： EP2AGX260EF29I3
廠商： Altera
文件頁數(shù)： 30/90頁
文件大?。?/td> 0K
描述： IC ARRIA II GX FPGA 260K 780FBGA
標準包裝： 4
系列： Arria II GX
LAB/CLB數(shù)： 10260
邏輯元件/單元數(shù)： 244188
RAM 位總計： 12038144
輸入/輸出數(shù)： 372
電源電壓： 0.87 V ~ 0.93 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 780-BBGA
供應(yīng)商設(shè)備封裝： 780-FBGA（29x29）
1–28
Chapter 1: Device Datasheet for Arria II Devices
Switching Characteristics
December 2013
Altera Corporation
Table 1–35 lists the transceiver specifications for Arria II GZ devices.
Table 1–35. Transceiver Specifications for Arria II GZ Devices (Part 1 of 5)
Symbol/
Description
Conditions
–C3 and –I3 (1)
–C4 and –I4
Unit
Min
Typ
Max
Min
Typ
Max
Reference Clock
Supported I/O Standards
1.2-V PCML, 1.5-V PCML, 2.5-V PCML, Differential LVPECL, LVDS, and HCSL
Input frequency from
REFCLK
input pins
—
50
—
697
50
—
637.5
MHz
Phase frequency detector
(CMU PLL and receiver
CDR)
—
50
—
325
50
—
325
MHz
Absolute VMAX for a REFCLK
pin
——
—
1.6
—
1.6
V
Operational VMAX for a
REFCLK
pin
——
—
1.5
—
1.5
V
Absolute VMIN for a REFCLK
pin
—
-0.4
—
-0.4
—
V
Rise/fall time (2)
—
0.2
—
0.2
UI
Duty cycle
—
45
—
55
45
—
55
%
Peak-to-peak differential
input voltage
—
200
—
1600
200
—
1600
mV
Spread-spectrum
modulating clock frequency
PCIe
30
—
33
30
—
33
kHz
Spread-spectrum
downspread
PCIe
—
0 to
-0.5%
——
0 to
-0.5%
——
On-chip termination
resistors
—
100
—
100
—
VICM (AC coupled)
—
1100 ± 10%
mV
VICM (DC coupled)
HCSL I/O standard
for PCIe reference
clock
250
—
550
250
—
550
mV
Transmitter REFCLK Phase
Noise
10 Hz
—
-50
—
-50
dBc/Hz
100 Hz
—
-80
—
-80
dBc/Hz
1 KHz
—
-110
—
-110
dBc/Hz
10 KHz
—
-120
—
-120
dBc/Hz
100 KHz
—
-120
—
-120
dBc/Hz
1 MHz
—
-130
—
-130
dBc/Hz
Transmitter REFCLK Phase
Jitter (rms) for 100 MHz
REFCLK (3)
10 KHz to 20 MHz
—
3
—
3
ps
RREF
——
2000 ±
1%
——
2000 ±
1%
—
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PDF描述
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