參數(shù)資料
型號(hào)： EP2AGX125DF25C5
廠商： Altera
文件頁(yè)數(shù)： 69/90頁(yè)
文件大小： 0K
描述： IC ARRIA II GX FPGA 125K 572FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 5
系列： Arria II GX
LAB/CLB數(shù)： 4964
邏輯元件/單元數(shù)： 118143
RAM 位總計(jì)： 8315904
輸入/輸出數(shù)： 260
電源電壓： 0.87 V ~ 0.93 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 572-FBGA
供應(yīng)商設(shè)備封裝： 572-FBGA
Chapter 1: Device Datasheet for Arria II Devices
1–63
Switching Characteristics
December 2013
Altera Corporation
tTX_JITTER (4)
True LVDS with
dedicated
SERDES
(data rate
600–1,250
Mbps)
—
175
—
175
—
225
—
300
ps
True LVDS with
dedicated
SERDES
(data rate
< 600 Mbps)
—
0.105
—
0.105
—
0.135
—
0.18
UI
True LVDS and
emulated
LVDS_E_3R
with logic
elements as
SERDES (data
rate 600
– 945 Mbps)
—
260
—
260
—
300
—
350
ps
True LVDS and
emulated
LVDS_E_3R
with logic
elements as
SERDES
(data rate
< 600 Mbps)
—
0.16
—
0.16
—
0.18
—
0.21
UI
tTX_DCD
True LVDS and
emulated
LVDS_E_3R
45
55
45
55
45
55
45
55
%
tRISE and tFALL
True LVDS and
emulated
LVDS_E_3R
—
200
—
200
—
225
—
250
ps
TCCS
True LVDS (5)
—
150
—
150
—
175
—
200
ps
Emulated
LVDS_E_3R
—
200
—
200
—
250
—
300
ps
Receiver (6)
True differential
I/O standards -
fHSDRDPA (data
rate)
SERDES factor
J = 3 to 10
150
1250
150
1250
150
1050
150
840
Mbps
Table 1–53. High-Speed I/O Specifications for Arria II GX Devices (Part 3 of 4)
Symbol
Conditions
I3
C4
C5,I5
C6
Unit
Min
Max
Min
Max
Min
Max
Min
Max
相關(guān)PDF資料
PDF描述
EP2AGX95EF35I5N IC ARRIA II GX FPGA 95K 1152FBGA
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EP1S40F1508C7N IC STRATIX FPGA 40K LE 1508-FBGA
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參數(shù)描述
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EP2AGX125DF25C6NES 制造商:Altera Corporation 功能描述:FPGA Arria
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