參數資料
| 型號： | EP2AGX125DF25C5 |
| 廠商： | Altera |
| 文件頁數： | 58/90頁 |
| 文件大小： | 0K |
| 描述： | IC ARRIA II GX FPGA 125K 572FBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 5 |
| 系列： | Arria II GX |
| LAB/CLB數： | 4964 |
| 邏輯元件/單元數： | 118143 |
| RAM 位總計： | 8315904 |
| 輸入/輸出數： | 260 |
| 電源電壓： | 0.87 V ~ 0.93 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 572-FBGA |
| 供應商設備封裝： | 572-FBGA |
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Chapter 1: Device Datasheet for Arria II Devices
1–53
Switching Characteristics
December 2013
Altera Corporation
Core Performance Specifications for the Arria II Device Family
This section describes the clock tree, phase-locked loop (PLL), digital signal
processing (DSP), embedded memory, configuration, and JTAG specifications for
Arria II GX and GZ devices.
Clock Tree Specifications
Table 1–42 lists the clock tree specifications for Arria II GX devices.
Table 1–43 lists the clock tree specifications for Arria II GZ devices.
PLL Specifications
Table 1–44 lists the PLL specifications for Arria II GX devices.
Table 1–42. Clock Tree Performance for Arria II GX Devices
Clock Network
Performance
Unit
I3, C4
C5,I5
C6
GCLK and RCLK
500
400
MHz
PCLK
420
350
280
MHz
Table 1–43. Clock Tree Performance for Arria II GZ Devices
Clock Network
Performance
Unit
–C3 and –I3
–C4 and –I4
GCLK and RCLK
700
500
MHz
PCLK
500
450
MHz
Table 1–44. PLL Specifications for Arria II GX Devices (Part 1 of 3)
Symbol
Description
Min
Typ
Max
Unit
fIN
Input clock frequency (from clock input pins residing in
right/top/bottom banks) (–4 Speed Grade)
5
—
670 (1)
MHz
Input clock frequency (from clock input pins residing in
right/top/bottom banks) (–5 Speed Grade)
5
—
622 (1)
MHz
Input clock frequency (from clock input pins residing in
right/top/bottom banks) (–6 Speed Grade)
5
—
500 (1)
MHz
fINPFD
Input frequency to the PFD
5
—
325
MHz
fVCO
PLL VCO operating Range (2)
600
—
1,400
MHz
fINDUTY
Input clock duty cycle
40
—
60
%
fEINDUTY
External feedback clock input duty cycle
40
—
60
%
tINCCJ (3),
Input clock cycle-to-cycle jitter (Frequency
100 MHz)
—
0.15
UI (p–p)
Input clock cycle-to-cycle jitter (Frequency
100 MHz)
—
±750
ps (p–p)
相關PDF資料 |
PDF描述 |
|---|---|
| EP2AGX95EF35I5N | IC ARRIA II GX FPGA 95K 1152FBGA |
| EP2AGX95EF35C4N | IC ARRIA II GX FPGA 95K 1152FBGA |
| EP2AGX95EF29I3N | IC ARRIA II GX FPGA 95K 780FBGA |
| EP1S40F1508C7N | IC STRATIX FPGA 40K LE 1508-FBGA |
| EP1SGX25CF672C6 | IC STRATIX GX FPGA 25KLE 672FBGA |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EP2AGX125DF25C5N | 功能描述:FPGA - 現場可編程門陣列 FPGA - Arria II GX 4964 LABs 260 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP2AGX125DF25C5NES | 制造商:Altera Corporation 功能描述:IC ARRIA II GX FPGA 572FBGA 制造商:Altera Corporation 功能描述:IC FPGA 260 I/O 572FBGA |
| EP2AGX125DF25C6 | 功能描述:FPGA - 現場可編程門陣列 FPGA - Arria II GX 4964 LABs 260 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
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| EP2AGX125DF25C6NES | 制造商:Altera Corporation 功能描述:FPGA Arria |
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