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參數資料
| 型號： | EP20K60ERC208-2ES |
| 元件分類： | 電源監(jiān)測 |
| 英文描述： | Dual Voltage Monitor with Intergrated CPU Supervisor |
| 中文描述： | 雙電壓監(jiān)視器集成CPU監(jiān)控 |
| 文件頁數： | 10/114頁 |
| 文件大?。?/td> | 1623K |
| 代理商： | EP20K60ERC208-2ES |
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Altera Corporation
107
APEX 20K Programmable Logic Device Family Data Sheet
Table 103. EP20K1000E fMAX Routing Delays
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tF1-4
0.21
0.23
0.46
ns
tF5-20
1.19
1.26
1.34
ns
tF20+
4.39
4.62
4.95
ns
Table 104. EP20K1000E Minimum Pulse Width Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tCH
2.00
2.50
2.75
ns
tCL
2.00
2.50
2.75
ns
tCLRP
0.17
0.22
0.29
ns
tPREP
0.17
0.22
0.29
ns
tESBCH
2.00
2.50
2.75
ns
tESBCL
2.00
2.50
2.75
ns
tESBWP
1.12
1.42
1.86
ns
tESBRP
0.96
1.22
1.60
ns
Table 105. EP20K1000E External Timing Parameters
Symbol
-1 Speed Grade
-2 Speed Grade
-3 Speed Grade
Unit
Min
Max
Min
Max
Min
Max
tINSU
2.23
2.40
2.55
ns
tINH
0.00
ns
tOUTCO
2.00
5.18
2.00
5.75
2.00
6.25
ns
tINSUPLL
1.66
1.75
-
ns
tINHPLL
0.00
-
ns
tOUTCOPLL
0.50
1.86
0.50
2.03
-
ns
相關PDF資料 |
PDF描述 |
|---|---|
| EP20K60ERC208-3ES | Dual Voltage Monitor with Intergrated CPU Supervisor |
| EP20K60ERC240-1ES | FPGA |
| EP20K60ERC240-2ES | FPGA |
| EP20K60ERC240-3ES | FPGA |
| EP20K60ERI208-1ES | FPGA |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EP20K60ERC208-3ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K60ERC240-1ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K60ERC240-2ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K60ERC240-3ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K60ERI208-1ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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